I
參數資料
型號： XRT86VX38IB329-F
廠商： Exar Corporation
文件頁數： 50/61頁
文件大?。?/td> 0K
描述： IC TI/E1/J1 FRAMER/LIU 329FPBGA
標準包裝： 90
控制器類型： T1/E1/J1 調幀器，LIU
電源電壓： 3.3V
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 329-FBGA
供應商設備封裝： 329-FPBGA（17x17）
包裝： 散裝
其它名稱： 1016-1439
XRT86VX38
51
OCTAL T1/E1/J1 FRAMER/LIU COMBO - HARDWARE DESCRIPTION
REV. 1.0.2
MICROPROCESSOR INTERFACE I/O TIMING
INTEL INTERFACE TIMING - ASYNCHRONOUS
The signals used for the Intel microprocessor interface are: Address Latch Enable (ALE), Read Enable (RD),
Write Enable (WR), Chip Select (CS), Address and Data bits. The microprocessor interface uses minimum
external glue logic and is compatible with the timings of the 8051 or 80188 family of microprocessors. The ALE
signal can be tied ’HIGH’ if this signal is not available, and the corresponding timing interface is shown in
Figure 11 and Table 14.
FIGURE 10. INTEL P INTERFACE TIMING DURING PROGRAMMED I/O READ AND WRITE OPERATIONS WHEN ALE IS
NOT TIED ’HIGH’
TABLE 13: INTEL MICROPROCESSOR INTERFACE TIMING SPECIFICATIONS
SYMBOL
PARAMETER
MIN
MAX
UNITS
t0
Valid Address to CS Falling Edge and ALE Rising
Edge
0-
ns
t1
ALE Falling Edge to RD Assert
5
-
ns
t2
RD Assert to RDY Assert
-
320
ns
NA
RD Pulse Width (t2)320
-
ns
t3
ALE Falling Edge to WR Assert
5
-
ns
t4
WR Assert to RDY Assert
-
320
ns
NA
WR Pulse Width (t4)320
-
ns
t5
ALE Pulse Width(t5)10
ns
CS
ADDR[14:0]
ALE
DATA[7:0]
RD
WR
RDY
Valid Data for Readback
Data Available to Write Into the LIU
READ OPERATION
WRITE OPERATION
t
0
t
0
t
1
t
4
t
2
t
3
Valid Address
t 5
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