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參數(shù)資料
| 型號： | XRT84L38_06 |
| 廠商： | Exar Corporation |
| 元件分類： | 通信及網(wǎng)絡(luò) |
| 英文描述： | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| 中文描述： | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| 文件頁數(shù)： | 279/453頁 |
| 文件大小： | 2982K |
| 代理商： | XRT84L38_06 |
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XRT84L38
259
REV. 1.0.1
OCTAL T1/E1/J1 FRAMER
The table below shows the combinations of Transmit Multiplex Enable bit and Transmit Interface Mode Select
[1:0] bits and the resulting Transmit Back-plane Interface data rates.
When the Transmit Multiplex Enable bit is set to zero, the framer is configured in non-channel-multiplexed
mode. The possible data rates are XRT84V24 Compatible 2.048Mbit/s, MVIP 2.048Mbit/s, 4.096Mbit/s and
8.192Mbit/s. In non-channel-multiplexed mode, payload data of each channel are taken from the Terminal
Equipment separately. Each channel uses its own Transmit Serial Clock, Transmit Serial Data, Transmit
Single-frame Synchronization signal and Transmit Multi-frame Synchronization signal as interface between the
framer and the Terminal Equipment. Section 1.1.2.1, 1.1.2.2 and 1.1.2.3 provide details on how to connect the
Transmit Payload Data Interface block with the Terminal Equipment when the Back-plane interface data rate is
1.544Mbit/s.
When the Back-plane interface data rate is MVIP 2.048Mbit/s, 4.096Mbit/s and 8.192Mbit/s, the Transmit
Serial Clock, Transmit Serial Data, Transmit Single-frame Synchronization signal and Transmit Multi-frame
Synchronization signal are all configured as inputs. The Transmit Serial Clock is always an input clock with
frequency of 2.048 MHz for all data rates. The TxMSync_n signal is configured as the Transmit Input Clock
with frequencies of 2.048 MHz, 4.096 MHz and 8.192 MHz respectively. It serves as the primary clock source
for the High-speed Back-plane Interface.
The table below summaries the clock frequencies of TxSerClk_n and TxInClk_n inputs when the framer is
operating in non-multiplexed High-speed Back-plane mode.
When the Transmit Multiplex Enable bit is set to one, the framer is configured in channel-multiplexed mode.
The possible data rates are bit-multiplexed 16.384Mbit/s, HMVIP 16.384Mbit/s and H.100 16.384Mbit/s. In
channel-multiplexed mode, every four channels share the Transmit Serial Data and Transmit Single-frame
Synchronization signal of one channel as interface between the framer and the local Terminal Equipment. The
TxMSync_n signal of one channel is configured as the Transmit Input Clock with frequencies of 16.384 MHz. It
serves as the primary clock source for the High-speed Back-plane Interface.
Payload and signaling data of Channel 0-3 are multiplexed onto the Transmit Serial Data pin of Channel 0.
Payload and signaling data of Channel 4-7 are multiplexed onto the Transmit Serial Data pin of Channel 4. The
T
RANSMIT
M
ULTIPLEX
E
NABLE
B
IT
T
RANSMIT
I
NTERFACE
M
ODE
S
ELECT
B
IT
1
T
RANSMIT
I
NTERFACE
M
ODE
S
ELECT
B
IT
0
B
ACK
-
PLANE
I
NTERFACE
D
ATA
R
ATE
0
0
0
XRT84V24 Compatible 2.048Mbit/s
0
0
1
MVIP 2.048Mbit/s
0
1
0
4.096Mbit/s
0
1
1
8.192Mbit/s
1
0
0
-
1
0
1
Bit Multiplexed 16.384Mbit/s
1
1
0
HMVIP 16.384Mbit/s
1
1
1
H.100 16.384Mbit/s
TRANSMIT MULTIPLEX ENABLE BIT = 0
T
RANSMIT
I
NTERFACE
M
ODE
S
ELECT
B
IT
1
T
RANSMIT
I
NTERFACE
M
ODE
S
ELECT
B
IT
0
B
ACK
-
PLANE
I
NTERFACE
D
ATA
R
ATE
T
X
S
ER
C
LK
T
X
MS
YNC
/T
X
I
N
C
LK
0
0
2.048Mbit/s
2.048 MHz
-
0
1
MVIP 2.048Mbit/s
2.048 MHz
2.048 MHz
1
0
4.096Mbit/s
2.048 MHz
4.096 MHz
1
1
8.192Mbit/s
2.048 MHz
8.192 MHz
相關(guān)PDF資料 |
PDF描述 |
|---|---|
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參數(shù)描述 |
|---|---|
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| XRT84L38-SL38PCI | 功能描述:網(wǎng)絡(luò)控制器與處理器 IC RoHS:否 制造商:Micrel 產(chǎn)品:Controller Area Network (CAN) 收發(fā)器數(shù)量: 數(shù)據(jù)速率: 電源電流（最大值）:595 mA 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:PBGA-400 封裝:Tray |
| XRT85L61 | 制造商:EXAR 制造商全稱:EXAR 功能描述:BITS (BUILDING INTEGRATED TIMING SUPPLY) CLOCK EXTRACTOR |
| XRT85L61_10 | 制造商:EXAR 制造商全稱:EXAR 功能描述:BITS (Building Integrated Timing Supply) Clock Extractor |
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