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參數(shù)資料
| 型號(hào)： | XRT84L38_06 |
| 廠商： | Exar Corporation |
| 元件分類： | 通信及網(wǎng)絡(luò) |
| 英文描述： | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| 中文描述： | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| 文件頁數(shù)： | 12/453頁 |
| 文件大小： | 2982K |
| 代理商： | XRT84L38_06 |
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XRT84L38
VIII
OCTAL T1/E1/J1 FRAMER
REV. 1.0.1
T
HIRD
O
CTET
OF
16.384M
BIT
/
S
D
ATA
S
TREAM
.......................................................................................... 296
F
IFTH
O
CTET
OF
16.384M
BIT
/
S
D
ATA
S
TREAM
.......................................................................................... 296
S
EVENTH
O
CTET
OF
16.384M
BIT
/
S
D
ATA
S
TREAM
..................................................................................... 296
S
ECOND
O
CTET
OF
16.384M
BIT
/
S
D
ATA
S
TREAM
...................................................................................... 297
F
OURTH
O
CTET
OF
16.384M
BIT
/
S
D
ATA
S
TREAM
...................................................................................... 297
S
IXTH
O
CTET
OF
16.384M
BIT
/
S
D
ATA
S
TREAM
.......................................................................................... 297
E
IGHTH
O
CTET
OF
16.384M
BIT
/
S
D
ATA
S
TREAM
....................................................................................... 297
F
IGURE
95. I
NTERFACING
XRT84L38
TO
LOCAL
TERMINAL
EQUIPMENT
USING
16.384M
BIT
/
S
DATA
BUS
......................................... 298
F
IGURE
96. T
IMING
S
IGNAL
WHEN
THE
FRAMER
IS
RUNNING
AT
HMVIP 16.384M
BIT
/
S
MODE
......................................................... 298
6.2.3.6 E1 R
ECEIVE
I
NPUT
I
NTERFACE
- H.100 16.384M
BIT
/
S
......................................................................................... 298
F
IRST
O
CTET
OF
16.384M
BIT
/
S
D
ATA
S
TREAM
.......................................................................................... 299
T
HIRD
O
CTET
OF
16.384M
BIT
/
S
D
ATA
S
TREAM
.......................................................................................... 299
F
IFTH
O
CTET
OF
16.384M
BIT
/
S
D
ATA
S
TREAM
.......................................................................................... 299
S
EVENTH
O
CTET
OF
16.384M
BIT
/
S
D
ATA
S
TREAM
..................................................................................... 299
S
ECOND
O
CTET
OF
16.384M
BIT
/
S
D
ATA
S
TREAM
...................................................................................... 300
F
OURTH
O
CTET
OF
16.384M
BIT
/
S
D
ATA
S
TREAM
...................................................................................... 300
S
IXTH
O
CTET
OF
16.384M
BIT
/
S
D
ATA
S
TREAM
.......................................................................................... 300
E
IGHTH
O
CTET
OF
16.384M
BIT
/
S
D
ATA
S
TREAM
....................................................................................... 300
F
IGURE
97. I
NTERFACING
XRT84L38
TO
LOCAL
TERMINAL
EQUIPMENT
USING
16.384M
BIT
/
S
DATA
BUS
......................................... 301
F
IGURE
98. T
IMING
S
IGNAL
WHEN
THE
FRAMER
IS
RUNNING
AT
H.100 16.384M
BIT
/
S
MODE
........................................................... 301
7.0 DS1 OVERHEAD INTERFACE BLOCK .............................................................................................. 302
7.1 DS1 TRANSMIT OVERHEAD INPUT INTERFACE BLOCK........................................................................... 302
7.1.1 DESCRIPTION OF THE DS1 TRANSMIT OVERHEAD INPUT INTERFACE BLOCK.............................................. 302
F
IGURE
99. B
LOCK
D
IAGRAM
OF
THE
DS1 T
RANSMIT
O
VERHEAD
I
NPUT
I
NTERFACE
OF
THE
XRT84L38 ........................................ 302
7.1.2 CONFIGURE THE DS1 TRANSMIT OVERHEAD INPUT INTERFACE MODULE AS SOURCE OF THE FACILITY DATA
LINK (FDL) BITS IN ESF FRAMING FORMAT MODE ............................................................................................... 302
T
RANSMIT
D
ATA
L
INK
S
ELECT
R
EGISTER
(TDLSR) (I
NDIRECT
A
DDRESS
= 0
XN
0H, 0
X
0AH)........................ 303
T
RANSMIT
D
ATA
L
INK
S
ELECT
R
EGISTER
(TDLSR) (I
NDIRECT
A
DDRESS
= 0
XN
0H, 0
X
0AH)........................ 303
F
IGURE
100. DS1 T
RANSMIT
O
VERHEAD
I
NPUT
I
NTERFACE
T
IMING
IN
ESF F
RAMING
F
ORMAT
MODE
............................................. 303
7.1.3 CONFIGURE THE DS1 TRANSMIT OVERHEAD INPUT INTERFACE MODULE AS SOURCE OF THE SIGNALING
FRAMING (FS) BITS IN N OR SLC96 FRAMING FORMAT MODE......................................................................... 304
T
RANSMIT
D
ATA
L
INK
S
ELECT
R
EGISTER
(TDLSR) (I
NDIRECT
A
DDRESS
= 0
XN
0H, 0
X
0AH)........................ 304
F
IGURE
101. DS1 T
RANSMIT
O
VERHEAD
I
NPUT
T
IMING
IN
N
OR
SLC96 F
RAMING
F
ORMAT
M
ODE
.............................................. 304
7.1.4 CONFIGURE THE DS1 TRANSMIT OVERHEAD INPUT INTERFACE MODULE AS SOURCE OF THE REMOTE SIG-
NALING (R) BITS IN T1DM FRAMING FORMAT MODE............................................................................................ 304
T
RANSMIT
D
ATA
LINK
SELECT
REGISTER
(
TDLSR
) (I
NDIRECT
ADDRESS
= 0
XN
0H, 0
X
0AH)........................... 305
F
IGURE
102. DS1 T
RANSMIT
O
VERHEAD
I
NPUT
I
NTERFACE
MODULE
IN
T1DM F
RAMING
F
ORMAT
MODE
........................................ 305
7.2 DS1 RECEIVE OVERHEAD OUTPUT INTERFACE BLOCK ......................................................................... 306
7.2.1 DESCRIPTION OF THE DS1 RECEIVE OVERHEAD OUTPUT INTERFACE BLOCK............................................. 306
F
IGURE
103. B
LOCK
D
IAGRAM
OF
THE
DS1 R
ECEIVE
O
VERHEAD
O
UTPUT
I
NTERFACE
OF
XRT84L38............................................ 306
7.2.2 CONFIGURE THE DS1 RECEIVE OVERHEAD OUTPUT INTERFACE MODULE AS DESTINATION OF THE FACILITY
DATA LINK (FDL) BITS IN ESF FRAMING FORMAT MODE .................................................................................... 306
R
ECEIVE
D
ATA
L
INK
S
ELECT
R
EGISTER
(TDLSR) (I
NDIRECT
A
DDRESS
= 0
XN
0H, 0
X
0AH).......................... 307
R
ECEIVE
D
ATA
L
INK
S
ELECT
R
EGISTER
(TDLSR) (I
NDIRECT
A
DDRESS
= 0
XN
0H, 0
X
0AH).......................... 307
F
IGURE
104. DS1 R
ECEIVE
O
VERHEAD
O
UTPUT
I
NTERFACE
MODULE
IN
ESF
FRAMING
FORMAT
MODE
........................................... 308
7.2.3 CONFIGURE THE DS1 RECEIVE OVERHEAD OUTPUT INTERFACE MODULE AS DESTINATION OF THE SIGNALING
FRAMING (FS) BITS IN N OR SLC96 FRAMING FORMAT MODE......................................................................... 308
R
ECEIVE
D
ATA
L
INK
S
ELECT
R
EGISTER
(TDLSR) (I
NDIRECT
A
DDRESS
= 0
XN
0H, 0
X
0AH)......................... 308
F
IGURE
105. DS1 R
ECEIVE
O
VERHEAD
O
UTPUT
I
NTERFACE
T
IMING
IN
N
OR
SLC96 F
RAMING
F
ORMAT
MODE
............................ 309
7.2.4 CONFIGURE THE DS1 RECEIVE OVERHEAD OUTPUT INTERFACE MODULE AS DESTINATION OF THE REMOTE
SIGNALING (R) BITS IN T1DM FRAMING FORMAT MODE ..................................................................................... 309
R
ECEIVE
D
ATA
L
INK
S
ELECT
R
EGISTER
(RDLSR) (I
NDIRECT
A
DDRESS
= 0
XN
0H, 0
X
0AH) ........................ 309
F
IGURE
106. DS1 R
ECEIVE
O
VERHEAD
O
UTPUT
I
NTERFACE
T
IMING
IN
T1DM F
RAMING
F
ORMAT
MODE
......................................... 310
8.0 E1 OVERHEAD INTERFACE BLOCK................................................................................................. 311
8.1 E1 TRANSMIT OVERHEAD INPUT INTERFACE BLOCK ............................................................................. 311
8.1.1 DESCRIPTION OF THE E1 TRANSMIT OVERHEAD INPUT INTERFACE BLOCK................................................. 311
F
IGURE
107. B
LOCK
D
IAGRAM
OF
THE
E1 T
RANSMIT
O
VERHEAD
I
NPUT
I
NTERFACE
OF
XRT84L38................................................ 311
8.1.2 CONFIGURE THE E1 TRANSMIT OVERHEAD INPUT INTERFACE MODULE AS SOURCE OF THE NATIONAL BIT SE-
QUENCE IN E1 FRAMING FORMAT MODE............................................................................................................... 311
S
YNCHRONIZATION
MUX R
EGISTER
(SMR) (I
NDIRECT
A
DDRESS
= 0
XN
0H, 0
X
09H) .................................. 312
T
RANSMIT
S
IGNALING
AND
D
ATA
L
INK
S
ELECT
R
EGISTER
(TSDLSR) (I
NDIRECT
A
DDRESS
= 0
XN
0H, 0
X
0AH) 312
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| XRT84L38IB | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| XRT84V24 | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| XRT86L30 | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| XRT86L30IB | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| XRT86SH221 | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| XRT84L38IB | 功能描述:網(wǎng)絡(luò)控制器與處理器 IC 8 Ch T1/E1 Framer RoHS:否 制造商:Micrel 產(chǎn)品:Controller Area Network (CAN) 收發(fā)器數(shù)量: 數(shù)據(jù)速率: 電源電流（最大值）:595 mA 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:PBGA-400 封裝:Tray |
| XRT84L38-L38PCI | 功能描述:網(wǎng)絡(luò)控制器與處理器 IC RoHS:否 制造商:Micrel 產(chǎn)品:Controller Area Network (CAN) 收發(fā)器數(shù)量: 數(shù)據(jù)速率: 電源電流（最大值）:595 mA 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:PBGA-400 封裝:Tray |
| XRT84L38-SL38PCI | 功能描述:網(wǎng)絡(luò)控制器與處理器 IC RoHS:否 制造商:Micrel 產(chǎn)品:Controller Area Network (CAN) 收發(fā)器數(shù)量: 數(shù)據(jù)速率: 電源電流（最大值）:595 mA 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:PBGA-400 封裝:Tray |
| XRT85L61 | 制造商:EXAR 制造商全稱:EXAR 功能描述:BITS (BUILDING INTEGRATED TIMING SUPPLY) CLOCK EXTRACTOR |
| XRT85L61_10 | 制造商:EXAR 制造商全稱:EXAR 功能描述:BITS (Building Integrated Timing Supply) Clock Extractor |
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