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參數(shù)資料
| 型號： | XC3S1400AN-5FGG484C |
| 廠商： | Xilinx Inc |
| 文件頁數(shù)： | 116/123頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC FPGA SPARTAN-3AN 484FPGA |
| 標準包裝： | 60 |
| 系列： | Spartan®-3AN |
| LAB/CLB數(shù)： | 2816 |
| 邏輯元件/單元數(shù)： | 25344 |
| RAM 位總計： | 589824 |
| 輸入/輸出數(shù)： | 372 |
| 門數(shù)： | 1400000 |
| 電源電壓： | 1.14 V ~ 1.26 V |
| 安裝類型： | 表面貼裝 |
| 工作溫度： | 0°C ~ 85°C |
| 封裝/外殼： | 484-BBGA |
| 供應商設備封裝： | 484-FBGA |
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Spartan-3AN FPGA Family: Pinout Descriptions
DS557 (v4.1) April 1, 2011
Product Specification
92
FGG400: 400-Ball Fine-Pitch Ball Grid Array
The 400-ball fine-pitch ball grid array, FGG400, supports the XC3S400AN FPGA as shown in Table 76 and Figure 22.
Table 76 lists all the FGG400 package pins. They are sorted by bank number and then by pin name. Pins that form a
differential I/O pair appear together in the table. The table also shows the pin number for each pin and the pin type (as
defined in Table 62).
www.xilinx.com/support/documentation/data_sheets/s3a_pin.zip.
Pinout Table
Table 76: Spartan-3AN FGG400 Pinout
Bank
Pin Name
FGG400
Ball
Type
0
IO_L01N_0
A18
I/O
0
IO_L01P_0
B18
I/O
0
IO_L02N_0
C17
I/O
0
IO_L02P_0/VREF_0
D17
VREF
0
IO_L03N_0
E15
I/O
0
IO_L03P_0
D16
I/O
0
IO_L04N_0
A17
I/O
0
IO_L04P_0/VREF_0
B17
VREF
0
IO_L05N_0
A16
I/O
0
IO_L05P_0
C16
I/O
0
IO_L06N_0
C15
I/O
0
IO_L06P_0
D15
I/O
0
IO_L07N_0
A14
I/O
0
IO_L07P_0
C14
I/O
0
IO_L08N_0
A15
I/O
0
IO_L08P_0
B15
I/O
0
IO_L09N_0
F13
I/O
0
IO_L09P_0
E13
I/O
0
IO_L10N_0/VREF_0
C13
VREF
0
IO_L10P_0
D14
I/O
0
IO_L11N_0
C12
I/O
0
IO_L11P_0
B13
I/O
0
IO_L12N_0
F12
I/O
0
IO_L12P_0
D12
I/O
0
IO_L13N_0
A12
I/O
0
IO_L13P_0
B12
I/O
0
IO_L14N_0
C11
I/O
0
IO_L14P_0
B11
I/O
0
IO_L15N_0/GCLK5
E11
GCLK
0
IO_L15P_0/GCLK4
D11
GCLK
0
IO_L16N_0/GCLK7
C10
GCLK
0
IO_L16P_0/GCLK6
A10
GCLK
0
IO_L17N_0/GCLK9
E10
GCLK
0
IO_L17P_0/GCLK8
D10
GCLK
0
IO_L18N_0/GCLK11
A8
GCLK
0
IO_L18P_0/GCLK10
A9
GCLK
0
IO_L19N_0
C9
I/O
0
IO_L19P_0
B9
I/O
0
IO_L20N_0
C8
I/O
0
IO_L20P_0
B8
I/O
0
IO_L21N_0
D8
I/O
0
IO_L21P_0
C7
I/O
0
IO_L22N_0/VREF_0
F9
VREF
0
IO_L22P_0
E9
I/O
0
IO_L23N_0
F8
I/O
0
IO_L23P_0
E8
I/O
0
IO_L24N_0
A7
I/O
0
IO_L24P_0
B7
I/O
0
IO_L25N_0
C6
I/O
0
IO_L25P_0
A6
I/O
0
IO_L26N_0
B5
I/O
0
IO_L26P_0
A5
I/O
0
IO_L27N_0
F7
I/O
0
IO_L27P_0
E7
I/O
0
IO_L28N_0
D6
I/O
0
IO_L28P_0
C5
I/O
0
IO_L29N_0
C4
I/O
0
IO_L29P_0
A4
I/O
0
IO_L30N_0
B3
I/O
0
IO_L30P_0
A3
I/O
0
IO_L31N_0
F6
I/O
0
IO_L31P_0
E6
I/O
Table 76: Spartan-3AN FGG400 Pinout (Cont’d)
Bank
Pin Name
FGG400
Ball
Type
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| 25AA080DT-I/MNY | IC SRL EEPROM 1KX8 1.8V 8-TDFN |
| 3344-38 | SCREW BRDLOCK M2.5 0.31" 1=1PC |
| XCV50E-7PQ240C | IC FPGA 1.8V 71K GATES 240-PQFP |
| 25AA080CT-I/MNY | IC SRL EEPROM 1KX8 1.8V 8-TDFN |
| 3344-26 | SCREW BRDLOCK M2.6 0.31" 1=1PC |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| XC3S1400AN-5FGG676C | 功能描述:IC FPGA SPARTAN -3N1400K 676FBGA RoHS:是 類別:集成電路 (IC) >> 嵌入式 - FPGA（現(xiàn)場可編程門陣列） 系列:Spartan®-3AN 標準包裝:60 系列:XP LAB/CLB數(shù):- 邏輯元件/單元數(shù):10000 RAM 位總計:221184 輸入/輸出數(shù):244 門數(shù):- 電源電壓:1.71 V ~ 3.465 V 安裝類型:表面貼裝 工作溫度:0°C ~ 85°C 封裝/外殼:388-BBGA 供應商設備封裝:388-FPBGA（23x23） 其它名稱:220-1241 |
| XC3S1500 | 制造商:XILINX 制造商全稱:XILINX 功能描述:Spartan-3 FPGA |
| XC3S1500-4CP132C | 制造商:XILINX 制造商全稱:XILINX 功能描述:Spartan-3 FPGA |
| XC3S1500-4CP132I | 制造商:XILINX 制造商全稱:XILINX 功能描述:Spartan-3 FPGA |
| XC3S1500-4CPG132C | 制造商:XILINX 制造商全稱:XILINX 功能描述:Spartan-3 FPGA Family: Complete Data Sheet |
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