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參數資料
| 型號： | W83L951DG |
| 廠商： | Nuvoton Technology Corporation of America |
| 文件頁數： | 96/112頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC EMBEDDED CNTRLR 128-LQFP |
| 標準包裝： | 90 |
| 系列： | W83 |
| 核心處理器： | 8051 |
| 芯體尺寸： | 8-位 |
| 速度： | 24MHz |
| 連通性： | 主機接口，PS/2，SMBus，UART/USART |
| 外圍設備： | PWM，WDT |
| 輸入/輸出數： | 104 |
| 程序存儲器容量： | 64KB（64K x 8） |
| 程序存儲器類型： | 閃存 |
| RAM 容量： | 2K x 8 |
| 電壓 - 電源 (Vcc/Vdd)： | 3 V ~ 3.6 V |
| 數據轉換器： | A/D 8x10b; D/A 2x8b |
| 振蕩器型： | 外部 |
| 工作溫度： | 0°C ~ 70°C |
| 封裝/外殼： | 128-LQFP |
| 包裝： | 托盤 |
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W83L951DG/W83L951FG
- 80 -
6.12 A/D Converter Block
W83L951DG/FG provides 8 A/D inputs. Analog input pin is selected in A/D Converter Register 0.
The A-D conversion register is a read-only register that stores the result of an A-D conversion. When
reading this register during an A-D conversion, the previous conversion result is read.
Table 6-21 A/D Convert Register Define
A/D CONVERT BLOCK(4)
EXTADDR
NAME
7
6
5
4
3
2
1
0
50
AD1
ADCST
Analog Input Select
ADCC
Reserved
Analog [1:0]
51
AD2
Analog [9:2]
54
PADMODE
AD7
AD6
AD5
AD4
AD3
AD2
AD1
AD0
Gray: Only with System Reset to initial.
6.12.1 Register Description
A/D converter is 10-bit converter. The VREF is Input of VREF pin.
The formula: A/D converter result= (Analog [9:0] / 1024) × VREF
6.12.1.1
A/D Converter Register 1 (AD1) (Default Value: 0000_00??)
Bit 7: ADC Start Bit
1: Start (Only one time)
0: No change.
When A/D Conversion Complete Status Bit is high, write 1 to this bit to start A/D convert. And ADC
Start Bit keeps low until hardware receives this request and can receive next request. And ADC Start
Bit changes from low to high at the time.
Bit 6~4: Analog Input Pin Select
000: GP60, 001: GP61, 010: GP62, 011: GP63,
100: GP64, 101: GP65, 110: GP66, 111: GP67.
Bit 3: A/D Conversion Complete Status Bit (Read Only)
0: Conversion in progress.
1: Conversion completed.
Bit 2: Reserved
Bit 1~0: A/D Converter Result [1:0]
A/D converter result bit1 is LSB.
When A/D Conversion Complete Status Bit is high, A/D Converter Result is valid.
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