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參數(shù)資料
| 型號： | W83L951DG |
| 廠商： | Nuvoton Technology Corporation of America |
| 文件頁數(shù)： | 77/112頁 |
| 文件大小： | 0K |
| 描述： | IC EMBEDDED CNTRLR 128-LQFP |
| 標(biāo)準(zhǔn)包裝： | 90 |
| 系列： | W83 |
| 核心處理器： | 8051 |
| 芯體尺寸： | 8-位 |
| 速度： | 24MHz |
| 連通性： | 主機(jī)接口，PS/2，SMBus，UART/USART |
| 外圍設(shè)備： | PWM，WDT |
| 輸入/輸出數(shù)： | 104 |
| 程序存儲器容量： | 64KB（64K x 8） |
| 程序存儲器類型： | 閃存 |
| RAM 容量： | 2K x 8 |
| 電壓 - 電源 (Vcc/Vdd)： | 3 V ~ 3.6 V |
| 數(shù)據(jù)轉(zhuǎn)換器： | A/D 8x10b; D/A 2x8b |
| 振蕩器型： | 外部 |
| 工作溫度： | 0°C ~ 70°C |
| 封裝/外殼： | 128-LQFP |
| 包裝： | 托盤 |
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W83L951DG/W83L951FG
6.7
Watch Dog Block
The watchdog timer gives a mean of returning to the reset state when a program cannot run on a
normal loop (for example, because of a software run-away). The watchdog timer consists of an 8-bit
timer L and an 8-bit timer H. At reset or writing to the watchdog timer control register WDTCON [7]
(START), each watchdog timer H and L is set to 0FFh.
About Watchdog timer H count size selection, we can use Bit 5 of the watchdog timer control register
(SIZE) permits selecting a watchdog timer H count source. When this bit is set to LOW, the count
source becomes the underflow signal of watchdog timer L.
Table 6-15.Watch Dog Register Define
WATCH DOG BLOCK(1)
EXTADDR
NAME
7
6
5
4
3
2
1
0
00
WDTCON
START
INTTYPE
SIZE
Clock Prescale Number[4:0]
01
WDTSTS
Reserved
+WDT
Gray: Only with System Reset (Pin Reset + WDT Reset) to Initial.
+: Only with Pin Reset to Initial
6.7.1
Register Description
6.7.1.1
Watch Dog Control Register (WDTCON) (Default Value: 0000_0000)
Reset with Power Reset & Pin Reset.
Bit 7: Start
1: Start / Reload
0: Stop
This Bit permits enable/disable the watchdog timer. Write LOW to this bit, the watchdog timer is
stopped. Write HIGH to this bit will reload the watchdog timer (watchdog timer H and L is set to 0FFh)
even this bit is already be HIGH. After written HIGH, the watchdog timer is running. Once this timer is
timed-out the chip is reset. Also the watchdog timer is stopped to prevent the next time-out.
Bit 6: Interrupt Type
1: NMI
0: Hardware reset
Bit 5: Size
Select the counter size. The counter starts from low to overflow. Then generate interrupt or hardware
reset.
1: One Byte Counter.
Frequency
Count
256
Limit
Timeout
WDT
≈
.
0: Two Byte Counter.
Frequency
Count
65536
Limit
Timeout
WDT
≈
.
Publication Release Date: August 2006
- 63 -
Revision 1.0
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