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參數(shù)資料
| 型號： | W83L951DG |
| 廠商： | Nuvoton Technology Corporation of America |
| 文件頁數(shù)： | 79/112頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC EMBEDDED CNTRLR 128-LQFP |
| 標準包裝： | 90 |
| 系列： | W83 |
| 核心處理器： | 8051 |
| 芯體尺寸： | 8-位 |
| 速度： | 24MHz |
| 連通性： | 主機接口，PS/2，SMBus，UART/USART |
| 外圍設(shè)備： | PWM，WDT |
| 輸入/輸出數(shù)： | 104 |
| 程序存儲器容量： | 64KB（64K x 8） |
| 程序存儲器類型： | 閃存 |
| RAM 容量： | 2K x 8 |
| 電壓 - 電源 (Vcc/Vdd)： | 3 V ~ 3.6 V |
| 數(shù)據(jù)轉(zhuǎn)換器： | A/D 8x10b; D/A 2x8b |
| 振蕩器型： | 外部 |
| 工作溫度： | 0°C ~ 70°C |
| 封裝/外殼： | 128-LQFP |
| 包裝： | 托盤 |
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W83L951DG/W83L951FG
Publication Release Date: August 2006
- 65 -
Revision 1.0
6.8
Timer Block
The Keyboard controller has four timers: timer X, timer Y, timer 1, and timer 2. The division ratio of
each timer or pre-scalar is given by 1/n + 1, where n is the value in the corresponding timer or pre-
scalar latch. All timers are count down. When the timer reaches "00H", an underflow occurs at the next
count pulse and the corresponding timer latch is reloaded into the timer and the count is continued.
When a timer is underflow, the corresponding interrupt request bit is set to 1.
In Timer 1 and Timer 2, the count source of pre-scalar 1/2 is the oscillator frequency divided by 16.
The output of pre-scalar 1/2 is counted for both timer 1 and 2, and a timer underflow sets the interrupt
request bit.
Timer X and Timer Y can works in one of four operating modes by setting the timer XY mode register.
Table 6-16.Timer Register Define
TIMER BLOCK(9)
EXTADDR
NAME
7
6
5
4
3
2
1
0
10
PRE1
TM1ST
Prescale 1 [6:0]
11
T1
Timer 1 [7:0]
12
PRE2
TM2ST
Prescale 2 [6:0]
13
T2
Timer 2 [7:0]
18
TM
TMYST
CNTR1
TMYMODE
TMXST
CNTR0
TMXMODE
19
PREX
Prescale X [7:0]
1A
TX
Timer X[7:0]
1B
PREY
Prescale Y [7:0]
1C
TY
Timer Y [7:0]
6.8.1
Register Description
6.8.1.1
Clock Prescale Number of Timer 1 (PRE1) (Default Value: 0111_1111)
Bit 7: Timer 1 Start Bit
Write: Start Timer 1 counter.
1: Enable (Prescale Counter Reload & Start, but Timer 1 Data Keep)
0: Disable
Read: Always Read ‘LOW’.
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