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參數(shù)資料
| 型號(hào)： | W83L951DG |
| 廠(chǎng)商： | Nuvoton Technology Corporation of America |
| 文件頁(yè)數(shù)： | 61/112頁(yè) |
| 文件大?。?/td> | 0K |
| 描述： | IC EMBEDDED CNTRLR 128-LQFP |
| 標(biāo)準(zhǔn)包裝： | 90 |
| 系列： | W83 |
| 核心處理器： | 8051 |
| 芯體尺寸： | 8-位 |
| 速度： | 24MHz |
| 連通性： | 主機(jī)接口，PS/2，SMBus，UART/USART |
| 外圍設(shè)備： | PWM，WDT |
| 輸入/輸出數(shù)： | 104 |
| 程序存儲(chǔ)器容量： | 64KB（64K x 8） |
| 程序存儲(chǔ)器類(lèi)型： | 閃存 |
| RAM 容量： | 2K x 8 |
| 電壓 - 電源 (Vcc/Vdd)： | 3 V ~ 3.6 V |
| 數(shù)據(jù)轉(zhuǎn)換器： | A/D 8x10b; D/A 2x8b |
| 振蕩器型： | 外部 |
| 工作溫度： | 0°C ~ 70°C |
| 封裝/外殼： | 128-LQFP |
| 包裝： | 托盤(pán) |
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W83L951DG/W83L951FG
- 48 -
6.4
System Management Bus Block
W83L951DG/FG provides 2 System Management Bus (SMBus) host controllers. The SMBus host
controllers is SMBUS 2.0 compatible. It also provides 32 bytes FIFO. The FIFO contains SMBus1
Master Data FIFO(8), SMBus2 Master Data FIFO(8).
Table 6-9 SMBus 1 Register Define
SMBUS 1 BLOCK(24)
INTADDR
NAME
7
6
5
4
3
2
1
0
B1
SM1SCR
Reserved
Baud Rate Select
RBIM
Reserved Reserved
B2
SM1IREQ
MSTS
MFIFORdy MFIFOReq MPktFinish
B3
SM1IE
Interrupt Enable [7:0]
B4
SM1FIFOCON STOP
RepStart
Master Level[1:0]
ClrMFIFO
ClrSFIFO Slave Leve[1:0]
B5
SM1MFIFO
Master Data FIFO [7:0]
B6
SM1MCON
MasterEn RMS
Read Byte Count[5:0]
B7
SM1MSTS
RxTMO
TxTMO
AlFull
AlEmty
WrErr
NACKRe ArbFail
ClrFinish
B9
SM1MFIFOSTS Full
Empty
FIFO Data Length[5:0]
BA
Reserved
BB
Reserved
BC
Reserved
BD
Reserved
Table 6-10 SMBus 2 Register Define
SMBUS 2 BLOCK(24)
INTADDR
NAME
7
6
5
4
3
2
1
0
C1
SM2SCR
Reserved
Baud Rate Select
RBIM
Reserved
C2
SM2IREQ
MSI
MFIFORdy MFIFOReq MPktFinish
C3
SM2IE
Interrupt Enable [7:0]
C4
SM2FIFOCON
STOP
RepStart
Master Level[1:0]
ClrMFIFO
ClrSFIFO
Slave Leve[1:0]
C5
SM2MFIFO
Master Data FIFO [7:0]
C6
SM2MCON
MasterEn
RMS
Read Byte Count[5:0]
C7
SM2MSTS
RxTMO
TxTMO
AlFull
AlEmty
WrErr
NACKRec
ArbFail
ClrFinish
C9
SM2MFIFOSTS
Full
Empty
FIFO Data Length[5:0]
CA
Reserved
CB
Reserved
CC
Reserved
CD
Reserved
Gray: Only with System Reset to initial.
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