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參數(shù)資料
| 型號： | W83L951DG |
| 廠商： | Nuvoton Technology Corporation of America |
| 文件頁數(shù)： | 49/112頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC EMBEDDED CNTRLR 128-LQFP |
| 標(biāo)準(zhǔn)包裝： | 90 |
| 系列： | W83 |
| 核心處理器： | 8051 |
| 芯體尺寸： | 8-位 |
| 速度： | 24MHz |
| 連通性： | 主機(jī)接口，PS/2，SMBus，UART/USART |
| 外圍設(shè)備： | PWM，WDT |
| 輸入/輸出數(shù)： | 104 |
| 程序存儲器容量： | 64KB（64K x 8） |
| 程序存儲器類型： | 閃存 |
| RAM 容量： | 2K x 8 |
| 電壓 - 電源 (Vcc/Vdd)： | 3 V ~ 3.6 V |
| 數(shù)據(jù)轉(zhuǎn)換器： | A/D 8x10b; D/A 2x8b |
| 振蕩器型： | 外部 |
| 工作溫度： | 0°C ~ 70°C |
| 封裝/外殼： | 128-LQFP |
| 包裝： | 托盤 |
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W83L951DG/W83L951FG
Publication Release Date: August 2006
- 37 -
Revision 1.0
6.1.1.18
External Wake-up 2 Register (EXTWKP2) (Default Value: 0000_0000)
Bit7~5: Reserved
Bit4: Enable RTC Interrupt wake-up W83L951DG/FG at power down mode.
1: Enable.
0: Disable.
Bit3: Enable LPC Interrupt wake-up W83L951DG/FG at power down mode.
1: Enable.
0: Disable.
Bit2: Enable APS2 Interrupt wake-up W83L951DG/FG at power down mode.
1: Enable.
0: Disable.
Note: Before enabling the function, Auxiliary PS2 Noise Filter Enable Bit (NFEN@PS2CON) must be
set low.
Bit1: Enable MPS2 Interrupt wake-up W83L951DG/FG at power down mode.
1: Enable.
0: Disable.
Note: Before enabling the function, Mouse PS2 Noise Filter Enable Bit (NFEN@PS2CON) must be set
low.
Bit0: Enable KPS2 Interrupt wake-up W83L951DG/FG at power down mode.
1: Enable.
0: Disable.
Note: Before enabling the function, Keyboard PS2 Noise Filter Enable Bit (NFEN@PS2CON) must be
set low.
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