參數(shù)資料
型號(hào)： UPD70F3015BGC-8EU-A
元件分類： 微控制器/微處理器
英文描述： 32-BIT, FLASH, 20 MHz, MICROCONTROLLER, PQFP100
封裝： 14 X 14 MM, LEAD FREE, PLASTIC, LQFP-100
文件頁數(shù)： 397/492頁
文件大小： 3420K
代理商： UPD70F3015BGC-8EU-A
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CHAPTER 17 ELECTRICAL SPECIFICATIONS
User’s Manual U12768EJ4V1UD
456
I
2C Bus Mode (
PD703014AY, 703014BY, 703015AY, 703015BY, 703017AY, 70F3015BY, 70F3017AY only)
(TA = –40 to +85°C, VDD = AVDD = BVDD = 2.7 to 3.6 V, VSS = AVSS = BVSS = 0 V, CL = 50 pF)
Normal Mode
High-Speed Mode
Parameter
Symbol
MIN.
MAX.
MIN.
MAX.
Unit
SCL clock frequency
fCLK
0
100
0
400
kHz
Bus-free time (between stop/start
conditions)
tBUF
<70>
4.7
–
1.3
–
s
Hold time
Note 1
tHD:STA
<71>
4.0
–
0.6
–
s
SCL clock low-level width
tLOW
<72>
4.7
–
1.3
–
s
SCL clock high-level width
tHIGH
<73>
4.0
–
0.6
–
s
Setup time for start/restart
condition
tSU:STA
<74>
4.7
–
0.6
–
s
CBUS compatible
master
5.0
–
s
Data hold
time
I
2C mode
tHD:DAT
<75>
0
Note 2
–
0
Note 2
0.9
Note 3
s
Data setup time
tSU:DAT
<76>
250
–
100
Note 4
–
ns
SDA and SCL signal rise time
tR
<77>
–
1000
20 + 0.1Cb
Note 5
300
ns
SDA and SCL signal fall time
tF
<78>
–
300
20 + 0.1Cb
Note 5
300
ns
Stop condition setup time
tSU:STO
<79>
4.0
–
0.6
–
s
Width of spike pulse suppressed
by input filter
tSP
<80>
–
0
50
ns
Capacitance load of each bus line
Cb
–
400
–
400
pF
Notes 1.
At the start condition, the first clock pulse is generated after the hold time.
2.
The system requires a minimum of 300 ns hold time internally for the SDA signal in order to occupy the
undefined area at the falling edge of SCL.
3.
If the system does not extend the SCL signal low hold time (tLOW), only the maximum data hold time
(tHD:DAT) needs to be satisfied.
4.
The high-speed mode I
2C bus can be used in the normal-mode I2C bus system. In this case, set the
high-speed mode I
2C bus so that it meets the following conditions.
If the system does not extend the SCL signal's low state hold time:
tSU:DAT
≥ 250 ns
If the system extends the SCL signal's low state hold time:
Transmit the following data bit to the SDA line prior to the SCL line release (tRmax. + tSU:DAT = 1,000 +
250 = 1,250 ns: Normal mode I
2C bus specification).
5.
Cb: Total capacitance of one bus line (unit: pF)
Remark The maximum operating frequency of the
PD703014AY, 703014BY, 703015AY, 703015BY, 703017AY,
70F3015BY, and
PD70F3017AY is fXX = 17 MHz.
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PDF描述
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UPD70F3040YGU-UEU-A 32-BIT, FLASH, 20 MHz, MICROCONTROLLER, PQFP176
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