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參數(shù)資料
| 型號： | STDM110 |
| 英文描述： | STDM110|Data Sheet |
| 中文描述： | STDM110 |數(shù)據(jù)資料 |
| 文件頁數(shù)： | 670/763頁 |
| 文件大?。?/td> | 2386K |
| 代理商： | STDM110 |
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STDM110
5-7
Samsung ASIC
SPSRAM_LP
Low-Power Single-Port Synchronous Static RAM
Pin Descriptions
Pin Capacitance
Unit: [SL]
DOUT
9.44
9.44
NOTE:
Each pin’s capacitance is exactly same regardless of available mux types for same bank.
Parameters
ba = 1
Ymux = 4
32
1024
16
64
2048
32
1
128
1
Ymux = 8
64
2048
32
128
4096
64
1
64
1
Ymux = 16
128
4096
64
256
8192
128
1
32
1
Ymux = 32
256
8192
128
512
16384
256
1
16
1
Words (w)
Min
Max
Step
Min
Max
Step
Min
Max
Step
ba = 2
Bpw (b)
Name
CK
I/O
Description
Clock
Clock input. CSN, WEN, A[] and DI[] are latched into the RAM on the rising
edge of CK. If CSN and WEN are low on the rising edge of CK, the RAM is in
write mode. If WEN is high on the rising edge of CK, the RAM is in read mode.
Upon the falling edge of CK, the RAM is in a precharge state.
Chip enable input. The chip enable is active-low and is latched into the RAM on
the rising edge of CK. When CSN is low, the RAM is enabled for reading or
writing, depending on the state of WEN. When CSN is high, the RAM goes to
the standby mode and is disabled for reading or writing. DOUT remains
previous data output.
Read or write enable input. The read/write enable is latched into the RAM on
the rising edge of CK. When WEN is low, data are written to the addressed
location and DOUT remains stable. When WEN is high, data from the
addressed word are present at DOUT.
Data output enable input. The data output enable is asynchronously operated
regardless of the state of other input. When OEN is high, DOUT is disabled and
goes to high-impedance state.
Address input bus. The address is latched into the RAM on the rising edge of
CK.
Data input bus. Data are latched on the rising edge of CK. Data input is written
into the addressed location in write mode.
Data output bus. Data output is valid after the rising edge of CK while the RAM
is in read mode. Data output remains previous data output while the RAM is in
write mode.
CSN
Chip
Enable
WEN
Read/Write
Enable
OEN
Data
Output
Enable
Address
A [ ]
DI [ ]
Data Input
DOUT [ ]
Data
Output
CK
8.15
8.15
CSN
14.34
14.34
WEN
7.73
7.73
OEN
5.75
5.75
A
DI
3.07
3.07
ba = 1
ba = 2
9.02
9.02
相關PDF資料 |
PDF描述 |
|---|---|
| STDRJ45 | Ethernet Patch Cords with connectors |
| STE150N10 | TRANSISTOR | MOSFET POWER MODULE | INDEPENDENT | 100V V(BR)DSS | 150A I(D) |
| STE15N100 | TRANSISTOR | MOSFET POWER MODULE | INDEPENDENT | 1KV V(BR)DSS | 15A I(D) |
| STE16N100 | TRANSISTOR | MOSFET POWER MODULE | INDEPENDENT | 1KV V(BR)DSS | 16A I(D) |
| STE180N05 | TRANSISTOR | MOSFET POWER MODULE | INDEPENDENT | 50V V(BR)DSS | 180A I(D) |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
| STDM12000100 | 制造商:Seagate Technology 功能描述:NAS WITH DRIVEGIG-E 12000 NAS - Trays |
| STDM4000100 | 制造商:Seagate Technology 功能描述:NAS WITH DRIVEGIG-E 4000 NAS - Trays |
| STDM8000100 | 制造商:Seagate Technology 功能描述:NAS WITH DRIVEGIG-E 8000 NAS - Trays |
| STDNCA-1.024 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Crystal Oscillator |
| STDNCA-1.544 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Crystal Oscillator |
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