參數(shù)資料
型號： SPAK56F826BU80
廠商： FREESCALE SEMICONDUCTOR INC
元件分類： 數(shù)字信號處理
英文描述： 16-BIT, 80 MHz, OTHER DSP, PQFP100
封裝： LQFP-100
文件頁數(shù)： 31/53頁
文件大?。?/td> 829K
代理商： SPAK56F826BU80
Synchronous Serial Interface (SSI) Timing
MOTOROLA
DSP56F826 Preliminary Technical Data
37
Delay from SRCK high to SRFS (bl) high - Slave5
tRFSBHS
0.1
46
ns
Delay from SRCK high to SRFS (wl) high - Slave5
tRFSWHS
0.1
46
ns
Delay from STCK high to STFS (bl) low - Slave5
tTFSBLS
-1
ns
Delay from STCK high to STFS (wl) low - Slave5
tTFSWLS
-1
ns
Delay from SRCK high to SRFS (bl) low - Slave5
tRFSBLS
-46
ns
Delay from SRCK high to SRFS (wl) low - Slave5
tRFSWLS
-46
ns
STCK high to STXD enable from high impedance - Slave
tTXES
ns
STCK high to STXD valid - Slave
tTXVS
125
ns
STFS high to STXD enable from high impedance (first bit) -
Slave
tFTXES
5.5
25
ns
STFS high to STXD valid (first bit) - Slave
tFTXVS
627
ns
STCK high to STXD not valid - Slave
tTXNVS
11
13
ns
STCK high to STXD high impedance - Slave
tTXHIS
11
28.5
ns
SRXD Setup time before SRCK low - Slave
tSS
4ns
SRXD Hold time after SRCK low - Slave
tHS
4ns
Synchronous Operation (in addition to standard external clock parameters)
SRXD Setup time before STCK low - Slave
tTSS
4
SRXD Hold time after STCK low - Slave
tTHS
4
1.
Slave mode is externally generated clocks and frame syncs
2.
Max clock frequency is IP_clk/4 = 40 MHz / 4 = 10 MHz for an 80 MHz part.
3.
All the timings for the SSI are given for a non-inverted serial clock polarity (TSCKP=0 in SCR2 and RSCKP=0
in SCSR) and a non-ionverted frame sync (TFSI=0 in SCR2 and RFSI=0 in SCSR). If the polarity of the clock and/or
the frame sync have been inverted, all the timings remain valid by inverting the clock signal STCK/SRCK and/or the
frame sync STFS/SRFS in the tables and in the figures.
4.
50% duty cycle
5.
bl = bit length; wl = word length
Table 18. SSI Slave Mode1 Switching Characteristics (Continued)
Operating Conditions: VSSIO=VSS = VSSA = 0V, VDDA =VDDIO=3.0–3.6V, VDD = 2.25–2.75V, TA = –40° to +85°C, CL ≤ 50 pF, fop = 80 MHz
Parameter
Symbol
Min
Typ
Max
Units
相關(guān)PDF資料
PDF描述
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參數(shù)描述
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SPAKDSP303VL100 功能描述:IC DSP 24BIT 100MHZ 196-MAPBGA RoHS:是 類別:集成電路 (IC) >> 嵌入式 - DSP（數(shù)字式信號處理器） 系列:DSP563xx 標(biāo)準(zhǔn)包裝:2 系列:StarCore 類型:SC140 內(nèi)核 接口:DSI，以太網(wǎng)，RS-232 時鐘速率:400MHz 非易失內(nèi)存:外部 芯片上RAM:1.436MB 電壓 - 輸入/輸出:3.30V 電壓 - 核心:1.20V 工作溫度:-40°C ~ 105°C 安裝類型:表面貼裝 封裝/外殼:431-BFBGA，F(xiàn)CBGA 供應(yīng)商設(shè)備封裝:431-FCPBGA（20x20） 包裝:托盤
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