參數(shù)資料
型號: SDED5-008G-NCY
廠商: SANDISK CORP
元件分類: 存儲控制器/管理單元
英文描述: FLASH MEMORY DRIVE CONTROLLER, PBGA115
封裝: 12 X 18 MM, 1.40 MM HEIGHT, FBGA-115
文件頁數(shù): 74/87頁
文件大?。?/td> 1675K
代理商: SDED5-008G-NCY
Rev. 1.2
Product Specifications
mDOC H3 EFD Featuring Embedded TrueFFS Data Sheet
76
92-DS-1205-10
10.3.10
SPI Timing
Table 22 lists SPI slave timing parameters. Figure 32 and Figure 33 show the SPI slave timing
diagram.
Table 22: Slave SPI Timing Parameters
Symbol
1.8V
3.3V
Description
Min
Max
Min
Max
Units
Notes
tw(SCLK1)
SCLK high pulse width
15
ns
tw(SCLK0)
SCLK low pulse width
15
ns
tcyc(SCLK)
SCLK period
40
ns
tsu(SI)
SI to SCLK setup
8
ns
tho(SI)
SCLK to SI hold
8
ns
tsu(SCS#)
SCS# to SCLK setup
8
ns
tho(SCS#)
SCLK to SCS# hold
16
ns
tw(SCS#1)
SCS# high pulse width
16
ns
tp(SO1)
SCLK to SO
delay
22
17
ns
tp(SO0)
SCLK to SO
delay
22
16
ns
thiz(SO)
SCS#
to SO Hi-Z
12
10
ns
tHIZ(SO)
tp(SI0)
tp(SI1)
tHO(SI)
tSU(SI)
tw(SCS#1)
tw(SCLK1)
tw(SCLK0)
tcyc(SCLK)
tw(SCLK0)
tw(SCLK1)
tcyc(SCLK)
SCLK (mode 0,3)
SCLK (mode 1,2)
SCS#
SI
SO
Figure 32: Slave SPI Data Timing
相關(guān)PDF資料
PDF描述
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