參數(shù)資料
型號(hào)： S1C62A33D
元件分類(lèi)： 微控制器/微處理器
英文描述： 4-BIT, MROM, 0.6 MHz, MICROCONTROLLER, UUC86
封裝： DIE-86
文件頁(yè)數(shù)： 207/280頁(yè)
文件大?。?/td> 1603K
代理商： S1C62A33D
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I-18
EPSON
S1C62N33 TECHNICAL HARDWARE
CHAPTER 4: PERIPHERAL CIRCUITS AND OPERATION (Memory Map)
Table 4.1(c) I/O memory map (F0H–F3H, F6H–F9H, FCH–FEH)
AMPON
R/W
*6
Falling
Mask
Address
Comment
Register
D3
D2
D1
D0
Name
Init
1
0
*1
F0H
SD0
R/W
SD3
SD2
SD1
SD0
*3
Serial interface data register
Low order (SD0–SD3)
SD1
SD2
SD3
F1H
SD4
R/W
SD7
SD6
SD5
SD4
*3
SD5
SD6
SD7
F2H
EISIO
R/W
SCS1
SCS0
SE2
EISIO
Clock edge selection register
Interrupt mask register (serial interface)
*6
SE2
SCS0
SCS1
1
0
ISIO
R
–
ISIO
0
Unused *5
Interrupt factor flag (serial interface) *4
Yes
No
–
F3H
F6H
–
BZFQ
–
0
Buzzer frequency selection register
Unused *5
2 kHz
4 kHz
–
R
–
BZFQ
R/W
F7H
–
AMPDT
AMPON
1
0
Unused *5
Analog comparator data
Analog comparator ON/OFF
On
Off
AMPDT
–
R
–
F8H
EV00
R
EV03
EV02
EV01
EV00
0
EV01
EV02
EV03
F9H
EV04
EV07
EV06
EV05
EV04
0
EV05
EV06
EV07
FCH
EVRST
W
–
EVRUN
–
EVRST
Unused *5
Event counter RUN/STOP
Unused *5
Event counter reset *5
–
R
EVRUN
R/W
–
R
FEH
IOC1
–
CLKCHG
OSCC
IOC1
0
OSCC
R/W
CLKCHG
–
R
FDH
P10
P13
P12
P11
P10
*2
High
Low
P11
P12
P13
R/W
*7
Rising
Enable
Serial interface data register
High order (SD4–SD7)
Clock edge selection register
(SCS0, SCS1)
Event counter
Low order (EV00–EV03)
Event counter
High order (EV04–EV07)
R
+ > -
- > +
*2
Run
Reset
Stop
–
*2
OSC3
On
Output
OSC1
Off
Input
0
Reset
*2
I/O port (P10–P13)
Output latch reset at time of initial reset
Unused *5
CPU clock switch
OSC3 oscillator ON/OFF
I/O control register 1 (P10–P13)
*2
相關(guān)PDF資料
PDF描述
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S1C63406F 4-BIT, MROM, 4.2 MHz, MICROCONTROLLER, PQFP128
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