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參數(shù)資料
| 型號(hào)： | QUADS68040UM_D |
| 英文描述： | M68360QUADS-040 User＇s Manual |
| 中文描述： | M68360QUADS - 040使用手冊(cè) |
| 文件頁數(shù)： | 3/86頁 |
| 文件大?。?/td> | 1351K |
| 代理商： | QUADS68040UM_D |
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M68360QUADS-040 - User’s Manual
TABLE OF CONTENTS
Draft 1.0
3.4
Programming the slave QUICC
Module Base Address Register
Module Configuration Register
CLKO Control Register
PLL Control Register
Port E Pin Assignment Register
System Protection Control
Global Memory Register
Base Register 0 and Option Register 0
Base Register 1 and Option Register 1
Base Register 2 and Option Register 2
Base Register 3 and Option Register 3
Base Register 4 and Option Register 4
Base Register 5 and Option Register 5
Base Register 6 and Option Register 6
Base Register 7 and Option Register 7
Port A Open Drain Register
Port A Data Register
Port A Data Direction Register
Port A Pin Assignment Register
Port B Open Drain Register
Port B Data Register
Port B Data Direction Register
Port B Pin Assignment Register
Port C Data Register
Port C Data Direction Register
Port C Pin Assignment Register
Port C Special Options Register
FUNCTIONAL DESCRIPTION
INTRODUCTION
Master MC68EC040
RESET for the 68EC040 & the QUICC
Utilizing the MC68EC040 Data Cache
Interrupts on the M68360QUADS-040
ABORT Push-button
Host - NMI
Hardware-Breakpoint Interrupt
Parity Error Interrupt
Host Request / Acknowledge Interrupt
Bus Arbitration
System Utilities
Breakpoints Generator
Bus Monitor
Spurious Interrupt Monitor
software Watch-Dog
Periodic Interval Timer - PIT
Clock Generator
Flash PROM
Bursting SRAM
EEPROM
DRAM
Slave QUICC
DRAM Controller
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4.10
4.11
4.11.1
F
Freescale Semiconductor, Inc.
For More Information On This Product,
Go to: www.freescale.com
n
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