參數(shù)資料
型號： PSD413A2V-A-20JI
廠商： 意法半導體
英文描述： Flash In-System Programmable ISP Peripherals For 8-bit MCUs
中文描述： Flash在系統(tǒng)可編程ISP的外設的8位微控制器
文件頁數(shù)： 94/120頁
文件大?。?/td> 563K
代理商： PSD413A2V-A-20JI
PSD813F1-A
Preliminary
90
-90
-12
-15
Symbol
Parameter
Conditions Min Max
Min
Max
Min
Max
Unit
t
ISCCF
t
ISCCH
t
ISCCL
t
ISCCF-P
t
ISCCH-P
t
ISCCL-P
t
ISCPSU
t
ISCPH
t
ISCPCO
TCK Clock Frequency (except for PLD)
TCK Clock High Time
TCK Clock Low Time
TCK Clock Frequency (for PLD only)
TCK Clock High Time (for PLD only)
TCK Clock Low Time (for PLD only)
ISC Port Set Up Time
ISC Port Hold Up Time
ISC Port Clock to Output
ISC Port High-Impedance to
Valid Output
ISC Port Valid Output to High-Impedance
(Note 1)
(Note 1)
(Note 1)
(Note 2)
(Note 2)
(Note 2)
18
16
14
MHz
ns
ns
MHz
ns
ns
ns
ns
ns
26
26
29
29
31
31
2
2
2
240
240
8
5
240
240
10
5
240
240
10
5
23
24
25
t
ISCPZV
23
24
25
ns
t
ISCPVZ
23
24
25
ns
ISC Timing
(5 V ± 10%)
Microcontroller Interface – PSD813F1 AC/DC Parameters
(5V ±10% Versions)
Symbol
Parameter
Min
Typ
Max
Unit
Flash Program
8.5
sec
Flash Bulk Erase (Preprogrammed) (Note 1)
3
30
sec
Flash Bulk Erase (Not Preprogrammed)
10
sec
t
WHQV3
t
WHQV2
t
WHQV1
Sector Erase (Preprogrammed)
1
30
sec
Sector Erase (Not Preprogrammed)
2.2
sec
Byte Program
14
1200
μs
Program/Erase Cycles (Per Sector)
100,000
cycles
t
WHWLO
Sector Erase Time-Out
100
μs
t
Q7VQV
DQ7 Valid to Output (DQ7-0) Valid
(Data Polling) (Note 2)
30
ns
Flash Program, Write and Erase Times
(5 V ± 10%)
NOTES:
1. Programmed to all zeros before erase.
2. The Polling Status DQ7 is valid t
Q7VQV
ns, before the data byte DQ0-7 is valid for reading.
EEPROM Write Times
(5 V ± 10%)
Symbol
Parameter
Min
Typ
Max
Unit
t
EEHWL
t
BLC
t
WCB
t
WCP
Write Protect After Power Up
5
msec
EEPROM Byte Load Cycle Timing (Note 1)
0.2
120
μsec
EEPROM Byte Write Cycle Time
4
10
msec
EEPROM Page Write Cycle Time (Note 2)
6
30
msec
Program/Erase Cycles (Per Sector)
10,000
cycles
NOTES:
1. If the maximum time has elapsed between successive writes to an EEPROM page, the transfer of this data to EEPROM cells will
begin. Also, bytes cannot be written (loaded) to a page any faster than the indicated minimum type.
2. These specifications are for writing a page to EEPROM cells.
NOTES:
1. For “non-PLD” programming, erase or in ISC by-pass mode.
2. For program or erase PLD only.
相關(guān)PDF資料
PDF描述
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PSOT03C STANDARD CAPACITANCE TVS ARRAY
PSOT03LC-LF-T13 ULTRA LOW CAPACITANCE TVS ARRAY
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PSD4235G2-90U 功能描述:CPLD - 復雜可編程邏輯器件 5.0V 4M 90ns RoHS:否 制造商:Lattice 系列: 存儲類型:EEPROM 大電池數(shù)量:128 最大工作頻率:333 MHz 延遲時間:2.7 ns 可編程輸入/輸出端數(shù)量:64 工作電源電壓:3.3 V 最大工作溫度:+ 90 C 最小工作溫度:0 C 封裝 / 箱體:TQFP-100
PSD4235G2-90UI 功能描述:CPLD - 復雜可編程邏輯器件 5.0V 4M 90ns RoHS:否 制造商:Lattice 系列: 存儲類型:EEPROM 大電池數(shù)量:128 最大工作頻率:333 MHz 延遲時間:2.7 ns 可編程輸入/輸出端數(shù)量:64 工作電源電壓:3.3 V 最大工作溫度:+ 90 C 最小工作溫度:0 C 封裝 / 箱體:TQFP-100
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