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參數(shù)資料
| 型號： | P16F877 |
| 廠商： | Microchip Technology Inc. |
| 英文描述： | DMOS MICROSTEPPING DRVR W/TRANSLATOR |
| 中文描述： | 28/40-Pin 8位CMOS閃存微控制器 |
| 文件頁數(shù)： | 96/218頁 |
| 文件大小： | 3824K |
| 代理商： | P16F877 |
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PIC16F87X
DS30292C-page 94
2001 Microchip Technology Inc.
9.3
Connection Considerations for
I
2
C Bus
For standard-mode I
2
C bus devices, the values of
resistors
R
p
and
R
s
in Figure 9-27 depend on the fol-
lowing parameters:
Supply voltage
Bus capacitance
Number of connected devices
(input current + leakage current)
The supply voltage limits the minimum value of resistor
R
p
,
due to the specified minimum sink current of 3 mA at
V
OL
max = 0.4V, for the specified output stages.
For
example, with a supply voltage of V
DD
= 5V±10% and
V
OL
max = 0.4V at 3 mA,
R
p
min = (5.5-0.4)/0.003 = 1.7 k
.
V
DD
as a function of
R
p
is shown in Figure 9-27. The
desired noise margin of 0.1V
DD
for the low level limits
the maximum value of
R
s
. Series resistors are optional
and used to improve ESD susceptibility.
The bus capacitance is the total capacitance of wire,
connections, and pins. This capacitance limits the max-
imum value of
R
p
due to the specified rise time
(Figure 9-27).
The SMP bit is the slew rate control enabled bit. This bit
is in the SSPSTAT register, and controls the slew rate
of the I/O pins when in I
2
C mode (master or slave).
FIGURE 9-27:
SAMPLE DEVICE CONFIGURATION FOR I
2
C BUS
R
p
R
p
V
DD
+ 10%
SDA
SCL
DEVICE
C
b
=10 - 400 pF
R
s
R
s
Note:
I
2
C devices with input levels related to V
DD
must have one common supply line to which the pull-up resistor is also
connected.
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