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參數(shù)資料
| 型號： | MPC8240EC |
| 廠商： | Motorola, Inc. |
| 英文描述： | Integrated Processor Hardware Specifications |
| 中文描述： | 綜合處理器硬件規(guī)格 |
| 文件頁數(shù)： | 7/52頁 |
| 文件大?。?/td> | 1027K |
| 代理商： | MPC8240EC |
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MOTOROLA
MPC8240 Integrated Processor Hardware Specifications
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7
Electrical and Thermal Characteristics
Figure 2 shows the supply voltage sequencing and separation cautions.
Figure 2. Supply Voltage Sequencing and Separation Cautions
OV
DD
/GV
DD
/(LV
DD
@ 3.3 V - - - -)
V
DD
/AV
DD
/AV
DD
2/LAV
DD
LV
DD
@ 5 V
Time
3.3 V
5 V
2.5 V
0
7
10
9
9
10
6,8
D
Voltage
Regulator
Delay
Reset
Configuration Pins
HRST_CPU and
HRST_CTRL
Asserted 255
External Memory
Clock Cycles
2
PLL
Relock
Time
2
100 μs
9 External Memory
Clock Cycles Setup Time
3
HRST_CPU and
HRST_CTRL
V
DD
Stable
Power Supply Ramp Up
See Note 1
VM = 1.4 V
One External Memory Clock Cycle
4
Maximum Rise Time Must be Less Than
Notes:
1. Numbers associated with waveform separations correspond to caution numbers listed in Table 2.
2. Refer to Table 7 for additional information on PLL relock and reset signal assertion timing requirements.
3. Refer to Table 8 for additional information on reset configuration pin setup timing requirements.
4. For the device to be in the non-reset state, HRST_CPU/HRST_CTRL must transition from a logic 0 to a
F
Freescale Semiconductor, Inc.
n
.
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