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參數(shù)資料
| 型號： | M37721 |
| 廠商： | Mitsubishi Electric Corporation |
| 英文描述： | 16-Bit Single-Chip Microcomputer(16位單片微控制器) |
| 中文描述： | 16位單片機(jī)（16位單片微控制器） |
| 文件頁數(shù)： | 363/576頁 |
| 文件大?。?/td> | 6745K |
| 代理商： | M37721 |
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DMA CONT R OLLE R
13.8 Link array chain transfer mode
13-85
7721 Group User‘s Manual
b7
b0
Selection of transfer mode and each function
b7
b0
0
b7
1
b0
0
0
1
From preceding “
Figure 13.8.3”
b0
b0
b7
(b7
(b8)
(bb0b7
b7
b0
b0
b0b7
b7
(b23)
(b8)
(b16)(b15)
DMA0 mode register L (Address 1FCC
16
)
DMA1 mode register L (Address 1FDC
16
)
DMA2 mode register L (Address 1FEC
16
)
DMA3 mode register L (Address 1FFC
16
)
Number-of-unit-transfer-bits select bit
0 : 16 bits
1 : 8 bits
Transfer method select bit
0 : 2-bus cycle transfer
1 : 1-bus cycle transfer
Transfer mode select bit
0 : Burst transfer mode
1 : Cycle-steal transfer mode
Transfer source address direction select bits
0 0 : Fixed
0 1 : Forward
1 0 : Backward
1 1 : Do not select.
Transfer destination address direction select bits
0 0 : Fixed
0 1 : Forward
1 0 : Backward
1 1 : Do not select.
DMA0 mode register H (Address 1FCD
16
)
DMA1 mode register H (Address 1FDD
16
)
DMA2 mode register H (Address 1FED
16
)
DMA3 mode register H (Address 1FFD
16
)
Transfer direction select bit (Used in 1-bus cycle transfer)
0 : From memory to I/O
1 : From I/O to memory
I/O connection select bit (Valid in 1-bus cycle transfer)
0 : Data bus D
0
–D
7
or D
0
–D
15
1 : Data bus D
8
–D
15
Transfer source wait bit
(Valid in DMA transfer)
0 : Wait
1 : No wait
Transfer destination wait bit
(Valid in DMA transfer)
0 : Wait
1 : No wait
Selection of link array chain transfer mode
Source address register 0 (Addresses 1FC2
16
to 1FC0
16
) (SAR0)
Source address register 1 (Addresses 1FD2
16
to 1FD0
16
) (SAR1)
Source address register 2 (Addresses 1FE2
16
to 1FE0
16
) (SAR2)
Source address register 3 (Addresses 1FF2
16
to 1FF0
16
) (SAR3)
Transfer counter register 0 (Addresses 1FCA
16
to 1FC8
16
) (TCR0)
Transfer counter register 1 (Addresses 1FDA
16
to 1FD8
16
) (TCR1)
Transfer counter register 2 (Addresses 1FEA
16
to 1FE8
16
) (TCR2)
Transfer counter register 3 (Addresses 1FFA
16
to 1FF8
16
) (TCR3)
Notes 1:
When writing to these registers,
write to all 24 bits.
2:
Do not write “000000
16
” to TCRi.
DMA0 control register (Address 1FCE
16
)
DMA1 control register (Address 1FDE
16
)
DMA2 control register (Address 1FEE
16
)
DMA3 control register (Address 1FFE
16
)
0 0 0 0 : Do not select.
0 0 0 1 :
External source (DMAREQi)
0 0 1 0 : Software DMA source
0 0 1 1 : Timer A0
0 1 0 0 : Timer A1
0 1 0 1 : Timer A2
0 1 1 0 : Timer A3
0 1 1 1 : Timer A4
1 0 0 0 : Timer B0
1 0 0 1 : Timer B1
1 0 1 0 : Timer B2
1 0 1 1 : UART0 receive
1 1 0 0 : UART0 transmit
1 1 0 1 : UART1 receive
1 1 1 0 : UART1 transmit
1 1 1 1 : A-D conversion
Edge sense/Level sense select bit
(Note)
0 : Edge sense
1 : Level sense
DMAACKi validity bit
0 : Invalid
1 : Valid
Note:
When an external source (DMAREQi)
is selected or when the cycle steal
transfer mode is selected, set this bit
to “0.”
Continue to
“Figure 13.8.5”
on next page.
DMA request source select bits
Set the start address of transfer parameter memory
of block which is first transferred.
These bits can be set to “000000
16
” to “FFFFFF
16
.”
Set the dummy data.
These bits can be set to “000001
16
” to “FFFFFF
16
.”
Fig. 13.8.4 Initial setting example for registers relevant to link array chain transfer mode (2)
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| M37733EHBXXXFP | 制造商:MITSUBISHI 制造商全稱:Mitsubishi Electric Semiconductor 功能描述:PROM VERSION OF M37733MHBXXXFP(MICROCOMPUTERS) |
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