參數(shù)資料
型號: L80600
英文描述: L80600 10/100/1000 Mbits/s Ethernet PHY technical manual 3/01
中文描述: L80600 10/100/1000 Mbits /秒以太網(wǎng)PHY技術(shù)手冊3月1日
文件頁數(shù): 68/192頁
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代理商: L80600
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4-4
Registers
4.2.1 Basic Mode Register (BMCR) Address 0x00
Reset
Reset
1 = Initiate software reset or indicates reset in process.
0, RW/SC
15
0 = Normal operation.
This bit sets the status and control registers of the PHY
to their default states. The bit is self-clearing and returns
a value of 1 until the reset process is complete
(approximately 1.2 ms for reset duration). Reset is
finished once the AutoNegotiation process has begun or
the device has entered its forced mode.
Loopback
Loopback
1 = Loopback enabled.
0, RW 14
0 = Normal operation.
The loopback function enables MII/GMII transmit data to
be routed to the MII/GMII receive data path.
Setting this bit may cause the descrambler to lose
synchronization and produce a 500
μ
s “dead time” before
any valid data appears at the MII receive outputs in
100 Mbits/s mode.
Speed[0]
Speed Select
When AutoNegotiation is disabled, bits 6 (Speed[1]) and
13 (Speed[0]) select device speed selection according to
the table below:
Strap Pin 208 0, RW 13
15
14
13
12
11
10
9
8
Reset
Loopback
Speed[0]
AN_ENable
Power_Down
Isolate
Restart_AN
Duplex
7
6
5
0
Collision Test
Speed[1]
Reserved
Speed[1:0]
Speed Mode
0b11
0b10
0b01
0b00
Reserved
1000 Mbits/s
100 Mbits/s
10 Mbits/s
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