參數(shù)資料
型號: L80600
英文描述: L80600 10/100/1000 Mbits/s Ethernet PHY technical manual 3/01
中文描述: L80600 10/100/1000 Mbits /秒以太網(wǎng)PHY技術(shù)手冊3月1日
文件頁數(shù): 56/192頁
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代理商: L80600
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3-6
Signals
3.3 Twisted-Pair (TP) Interface
The following signals provide the means for the L80600 to communicate
to the media.
TXD[A:D]+/-
Transmit Data
The TP Interface connects the L80600 to the CAT-5 cable
through a single common magnetics transformer. The
Transmit (TXD) and Receive (RXD) twisted-pair pins
carry bit-serial data at a 125 MHz baud rate. These
differential outputs are configurable to either
100BASE-TX or 1000BASE-T signalling as follows:
O [9:10, 13:14, 39:40, 43:44]
100BASE-TX: Transmission of 3-level MLT-3 data.
1000BASE-T: Transmission of 17-level PAM-5 with
PR-shaping data.
The L80600 automatically configures the common driver
outputs for the proper signal type as a result of either
forced configuration or AutoNegotiation.
Note:
During 10/100 Mbit/s operation, only TXDA+ and TXDA-
are active
RXD[A:D]+/-
Receive Data
Differential receive signals.
I[4:5, 18:19, 34:35, 48:49]
Note:
During 10/100 Mbit/s operation, only RXDB+ and RXDB-
are active.
3.4 JTAG Interface
This section describes the JTAG signals used for device testing.
TRSTn
Test Reset
IEEE 1149.1 Test Reset pin. This pin is an active-LOW
reset and provides for asynchronous reset of the Tap
Controller. This reset has no effect on the device
registers.
I 156
This pin should be tied LOW during regular chip
operation.
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