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參數(shù)資料
| 型號： | ISPPAC-POWR6AT6-01NN32I |
| 廠商： | LATTICE SEMICONDUCTOR CORP |
| 元件分類： | 電源管理 |
| 英文描述： | In-System Programmable Power Supply Monitoring and Margining Controller |
| 中文描述： | 6-CHANNEL POWER SUPPLY SUPPORT CKT, QCC32 |
| 封裝： | 5 X 5 MM, LEAD FREE, QFN-32 |
| 文件頁數(shù)： | 20/34頁 |
| 文件大小： | 906K |
| 代理商： | ISPPAC-POWR6AT6-01NN32I |
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Lattice Semiconductor
ispPAC-POWR6AT6 Data Sheet
20
the SMBus Alert cycle. Refer to the CLTLOCK/SMBA pin and SMBus Alert sections of this datasheet for more
information on how the closed-loop trim status in this I
2
C register is used.
Figure 15. I
2
C Closed Loop Trim Status Register
It is possible to read the value of the voltage present on any of the VMON inputs by using the ispPAC-POWR6AT6’s
ADC. Three registers provide the I
2
C interface to the ADC (Figure 16).
Figure 16. ADC Interface Registers
To perform an A/D conversion, one must set the input attenuator and channel selector. Two input ranges may be
set using the attenuator, 0 - 2.048V and 0 - 6.144V. Table 5 shows the input attenuator settings.
Table 5. ADC Input Attenuator Control
The input selector may be set to monitor any one of the six VMON inputs or the VCCA input. Table 6 shows the
codes associated with each input selection.
Table 6. V
MON
Address Selection Table
ATTEN (ADC_MUX.4)
0
1
Resolution
2mV
6mV
Full-Scale Range
2.048 V
6.144 V
Select Word
SEL1
(ADC_MUX.1)
0
0
1
1
0
0
Input Channel
VMON1
VMON2
VMON3
VMON4
VMON5
VMON6
SEL2
(ADC_MUX.2)
0
0
0
0
1
1
SEL0
(ADC_MUX.0)
0
1
0
1
0
1
X
SMBA
in6
in5
in4
in3
in2
in1
b7
b0
b6
b5
b4
b3
b2
b1
0x00 – CLTLOCK_STATUS (b6 = Read/Write; all others Read Only)
D3
D2
D1
D0
1
1
1
DONE
b7
b0
0x01 - ADC_VALUE_LOW
(Read Only)
b6
b5
b4
b3
b2
b1
D11
D10
D9
D8
D7
D6
D5
D4
b7
b0
0x02 - ADC_VALUE_HIGH
(Read Only)
b6
b5
b4
b3
b2
b1
X
X
X
X
ATTEN
SEL2
SEL1
SEL0
b7
b0
0x03 - ADC_MUX (Read/Write)
b6
b5
b4
b3
b2
b1
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