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參數(shù)資料
| 型號(hào)： | GL9701-MXG |
| 廠商： | Genesys Logic, Inc. |
| 英文描述： | PCI ExpressTM to PCI Bridge |
| 中文描述： | 的PCI ExpressTM到PCI橋 |
| 文件頁(yè)數(shù)： | 61/75頁(yè) |
| 文件大小： | 1077K |
| 代理商： | GL9701-MXG |
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GL9701 PCI Express
TM
to PCI Bridge
2000-2006 Genesys Logic Inc. - All rights reserved.
Page 61
4:0
ROS
00h
Secondary Uncorrectable First Error Pointer
6.55 Offset 13ch: Secondary Header Log Register
Bits
Type
Default
Description
35:0
ROS
0h
Transaction Attribute
–
Not supported.
39:36
ROS
0h
Transaction Command Lower
–
The 4-bit value transferred on
C/BE[3:0]# during the first address
phase.
43:40
ROS
0h
Transaction Command Upper
–
Not supported
127:64
ROS
0h
Transaction Address
–
bits 127:96 will be set to zero
6.56 Offset 150h: Device Serial Number Enhanced Capability Header Register
Bits
Type
Default
Description
15:0
RO
0003h
PCI Express Extended Capability ID
19:16
RO
1h
Capability Version
31:20
RO
000h
Next Capability Offset
6.57 Offset 154h: Device Serial Number Register
Bits
Type
Default
Description
63:0
RO
0h
PCI Express Device Serial Number
相關(guān)PDF資料 |
PDF描述 |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
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