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參數(shù)資料
| 型號： | AMD-645 |
| 廠商： | ADVANCED MICRO DEVICES INC |
| 元件分類： | 外設及接口 |
| 英文描述： | Peripheral Bus Controller(外圍總線控制器) |
| 中文描述： | MULTIFUNCTION PERIPHERAL, PQFP208 |
| 封裝： | PLASTIC, QFP-208 |
| 文件頁數(shù)： | 125/242頁 |
| 文件大小： | 2929K |
| 代理商： | AMD-645 |
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Initialization
6-13
21095B/0—June 1997
AMD-645 Peripheral Bus Controller Data Sheet
Preliminary Information
6.5.2
Power Management I/O Space Registers
Table 6-21.
Configuration Space Power Management Registers
Offset
Register
Default
Recommended
Access
Setting
C0h
Result
40h
Pin Configuration
C0h
Define pin 136 as GPIO4
Define pin 92 as GPIO4
Disable PWRBTN# debounce
Disable ACPI timer reset
ACPI 24-bit timer count
32us clock throttling
Disable SCI interrupt
RW
41h
General Configuration
00h
00h
RW
42h
43h
SCI Interrupt Configuration
Reserved
Primary Interrupt Channel
Secondary Interrupt Channel
GP Timer Control
00h
00h
0000h
0000h
00000000h
00h
00h
0000h
0000h
00000000h
RW
RW
RW
RW
RW
45h–44h
47h–46h
53h–50h
Disable pri interrupt channel
Disable sec interrupt channel
Disable conserve mode
Disable sec event time
Disable GP1 timer
Disable GP0 timer
54h–60h
61h
Reserved
Programming Interface Read
Value
Sub Class Read Value
00h
00h
00h
00h
—
Value to be returned by register
at offset 09h
Value to be returned by register
at offset 0Ah
Value to be returned by register
at offset 0Bh
WO
62h
00h
00h
WO
63h
Base Class Read Value
00h
00h
WO
64h–FFh
Reserved
00h
00h
—
Table 6-22.
Basic Power Management Control/Status Registers
Offset
01h–00h
03h–02h
05h–04h
0Bh–08h
Register Name
Default
00h
00h
00h
00h
Access
RWC
RW
RW
RW
Power Management Status
Power Management Enable
Power Management Control
Power Management Timer
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PDF描述 |
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