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參數(shù)資料
| 型號： | AK4671 |
| 廠商： | Asahi Kasei Microsystems Co.,Ltd |
| 元件分類： | Codec |
| 英文描述： | Stereo CODEC with MIC/RCV/HP-AMP |
| 中文描述： | 立體聲編解碼器麥克風(fēng)/垃圾車/惠普腺苷 |
| 文件頁數(shù)： | 101/164頁 |
| 文件大小： | 1792K |
| 代理商： | AK4671 |
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[AK4671]
MS0666-E-00
2007/10
- 101 -
a) PLLBT reference clock: SYNCA or BICKA pin
The PLLBT circuit generates the required clock for PCM I/F from SYNCA or BICKA. Generated clocks are output via
SYNCB and BICKB pins.
AK4671
Phone Module
BICKA
SDTOA
SDTIA
SYNCB
SDTI
SDTO
SYNC
SYNCA
1fs2
≥
16fs2
BICK
BICKB
SDTOB
SDTIB
SDTI
SDTO
1fs2
16fs2 or 32fs2
BICK
SYNC
Bluetooth Module
Figure 82. PCM I/F (PLLBT Reference Clock: SYNCA or BICKA pin)
b) PLLBT reference clock: SYNCB or BICKB pin
The PLLBT circuit generates the required clock for PCM I/F from SYNCB or BICKB. Generated clocks are output via
SYNCA and BICKA pins.
AK4671
Phone Module
BICKA
SDTOA
SDTIA
SYNCB
SDTI
SDTO
SYNC
SYNCA
1fs2
16fs2 or 32fs2
BICK
BICKB
SDTOB
SDTIB
SDTI
SDTO
1fs2
≥
16fs2
BICK
SYNC
Bluetooth Module
Figure 83. PCM I/F (PLLBT Reference Clock: SYNCB or BICKB pin)
PLLBT should always be powered-up (PMPCM bit = “1”) whenever SRC-A or SRC-B is in operation (PMSRA bit = “1”
or PMSRB bit = “1”). If PLLBT is powered-down, the AK4671 may draw excess current and it is not possible to operate
properly because utilizes dynamic refreshed logic internally. If PLLBT is powered-down, SRC-A, SRC-B and SRC-C
should be in the power-down mode (PMSRA=PMSRB bits = “0”).
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PDF描述 |
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