參數(shù)資料
型號(hào)： AK4371VN
廠商： Asahi Kasei Microsystems Co.,Ltd
英文描述： DAC with built-in PLL & HP-AMP
中文描述： DAC，帶有內(nèi)置的鎖相環(huán)
文件頁數(shù)： 21/62頁
文件大?。?/td> 842K
代理商： AK4371VN
[AK4371]
MS0596-E-00
2007/04
- 21 -
■
PLL Master Mode (PMPLL bit = “1”, M/S bit = “1”)
When an external clock (11.2896MHz, 12MHz, 13MHz, 14.4MHz, 15.36MHz, 19.2MHz, 19.68MHz,19.8MHz, 26MHz
or 27MHz) is input to MCKI pin, the MCKO, BICK and LRCK clocks are generated by an internal PLL circuit. The
MCKO output frequency is selected by PS1-0 bits (Table 9) and the output is enabled by MCKO bit. The BICK output
frequency is selected between 32fs or 64fs, by BF bit (Table 10).
AK4371
DSP or
μ
P
MCKO
BICK
LRCK
SDATA
BCLK
LRCK
SDTO
MCKI
1fs
32fs, 64fs
256fs/128fs/64fs/32fs
27MHz,26MHz,19.8MHz,19.68MHz,
19.2MHz,15.36MHz,14.4MHz,13MHz,
12MHz,11.2896MHz
MCLK
Figure 11. PLL Master Mode
PS1
0
0
1
1
PS0
0
1
0
1
MCKO
256fs
128fs
64fs
32fs
(default)
Table 9. MCKO Frequency (PLL mode, MCKO bit = “1”)
BF bit
0
1
Table 10. BICK Output Frequency at Master Mode
BICK Frequency
32fs
64fs
(default)
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PDF描述
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AK4382A 112dB 192kHz 24-Bit 2ch DAC
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