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參數(shù)資料
| 型號(hào)： | AK4371VN |
| 廠(chǎng)商： | Asahi Kasei Microsystems Co.,Ltd |
| 英文描述： | DAC with built-in PLL & HP-AMP |
| 中文描述： | DAC，帶有內(nèi)置的鎖相環(huán) |
| 文件頁(yè)數(shù)： | 14/62頁(yè) |
| 文件大?。?/td> | 842K |
| 代理商： | AK4371VN |
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[AK4371]
MS0596-E-00
2007/04
- 14 -
Parameter
Control Interface Timing (I
2
C Bus mode):
(Note 29)
SCL Clock Frequency
Bus Free Time Between Transmissions
Start Condition Hold Time (prior to first clock pulse)
Clock Low Time
Clock High Time
Setup Time for Repeated Start Condition
SDA Hold Time from SCL Falling (Note 30)
SDA Setup Time from SCL Rising
Rise Time of Both SDA and SCL Lines
Fall Time of Both SDA and SCL Lines
Setup Time for Stop Condition
Capacitive Load on Bus
Pulse Width of Spike Noise Suppressed by Input Filter
Power-down & Reset Timing
PDN Pulse Width
(Note 31)
Note 29. I
2
C is a registered trademark of Philips Semiconductors.
Note 30. Data must be held long enough to bridge the 300ns-transition time of SCL.
Note 31. The AK4371 can be reset by bringing PDN pin = “L” to “H” only upon power up.
Symbol
fSCL
tBUF
tHD:STA
tLOW
tHIGH
tSU:STA
tHD:DAT
tSU:DAT
tR
tF
tSU:STO
Cb
tSP
tPD
min
-
1.3
0.6
1.3
0.6
0.6
0
0.1
-
-
0.6
-
0
150
typ
-
-
-
-
-
-
-
-
-
-
-
-
-
-
max
400
-
-
-
-
-
-
-
0.3
0.3
-
400
50
-
Units
kHz
μ
s
μ
s
μ
s
μ
s
μ
s
μ
s
μ
s
μ
s
μ
s
μ
s
pF
ns
ns
相關(guān)PDF資料 |
PDF描述 |
|---|---|
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參數(shù)描述 |
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