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參數資料
| 型號： | AD9992BBCZRL |
| 廠商： | Analog Devices Inc |
| 文件頁數： | 75/92頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC CCD SGNL PROC 12BIT 105CSPBGA |
| 產品變化通告： | AD9992 Discontinuation 22/Feb/2012 |
| 標準包裝： | 2,000 |
| 類型： | CCD 信號處理器，12 位 |
| 輸入類型： | 邏輯 |
| 輸出類型： | 邏輯 |
| 接口： | 3 線串口 |
| 電流 - 電源： | 27mA |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 105-LFBGA，CSPBGA |
| 供應商設備封裝： | 105-CSPBGA（8x8） |
| 包裝： | 帶卷 (TR) |
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AD9992
Rev. C | Page 77 of 92
Table 32. I/O and Charge Pump Registers
Address
Data
Bits
Default
Value
Update
Type
Mnemonic
Description
0x23
[0]
0
SCK
OSC_NVR
Oscillator normal voltage range. Set to match CLIVDD supply voltage.
0: 1.8 V.
1: 3.3 V.
[1]
0
XV_NVR
XV output normal voltage range. Set to match XVVDD supply voltage.
0: 1.8 V.
1: 3.3 V.
[2]
0
IO_NVR
I/O normal voltage range. Set the match IOVDD supply voltage.
0: 1.8 V.
1: 3.3 V.
[3]
0
DATA_NVR
Data pin normal voltage range. Set to match DRVDD supply voltage.
0: 1.8 V I/O.
1: 3.3 V I/O.
[4]
0
TEST
Test mode only. Set to 0.
[5]
0
TEST
Test mode only. Set to 0.
[6]
0
LDO_32_EN
1: Internal regulator enable for 3.2 V output.
[9:7]
1
HCLKMODE
Selects HCLK output configuration. Should be written to desired value.
001: Mode 1.
010: Mode 2.
100: Mode 3.
All other values are invalid.
0x24
[0]
0
SCK
SEL_VCO
1: Internal CP clock select VCO.
[1]
1
SEL_DIV
1: Internal CP clock select divided-down version of CLI (default).
[2]
0
SEL_CLI
1: Internal CP clock select CLI.
[3]
0
O31V
1: CP output voltage is 3.1 V.
[4]
0
O32V
1: CP output voltage is 3.2 V.
[5]
1
O33V
1: CP output voltage is 3.3 V.
[6]
0
O34V
1: CP output voltage is 3.4 V.
[7]
1
TEST
Test mode only. Use default values only.
[8]
1
TEST
Test mode only. Use default values only.
[9]
1
TEST
Test mode only. Use default values only.
[10]
1
TEST
Test mode only. Use default values only.
[11]
0
TEST
Test mode only. Use default values only.
[12]
0
TEST
Test mode only. Use default values only.
[13]
0
TEST
Test mode only. Use default values only.
[14]
1
CP_PDN
Charge pump power-down.
1: Power-down.
0: CP is running.
0x25
[24:0]
0
SCK
VT_STBY12
[23:0] Standby1 and Standby2 polarity for XV [23:0].
[24] Standby1 and Standby2 polarity for XSUBCK.
Settings also apply when OUTCONTROL = low.
0x26
[24:0]
0
SCK
VT_STBY3
[23:0] Standby3 polarity for XV [23:0].
[24] Standby3 polarity for XSUBCK.
0x27
[7:0]
0
SCK
GP_STDBY12
Standby1 and Standby2 polarity for GPO [7:0].
Settings also apply when OUTCONTROL = low.
[15:8]
GP_STDBY3
Standby3 polarity for GPO [7:0].
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