1SYNC_MASK_VD IS A NEW REGISTER. HI WILL MASK VD. DEFAULT = HI.
參數(shù)資料
型號: AD9992BBCZRL
廠商: Analog Devices Inc
文件頁數(shù): 57/92頁
文件大?。?/td> 0K
描述: IC CCD SGNL PROC 12BIT 105CSPBGA
產(chǎn)品變化通告: AD9992 Discontinuation 22/Feb/2012
標準包裝: 2,000
類型: CCD 信號處理器,12 位
輸入類型: 邏輯
輸出類型: 邏輯
接口: 3 線串口
電流 - 電源: 27mA
安裝類型: 表面貼裝
封裝/外殼: 105-LFBGA,CSPBGA
供應(yīng)商設(shè)備封裝: 105-CSPBGA(8x8)
包裝: 帶卷 (TR)
AD9992
Rev. C | Page 60 of 92
1
2
3
1SYNC_MASK_VD IS A NEW REGISTER. HI WILL MASK VD. DEFAULT = HI.
2SYNC_MASK_HD IS A NEW REGISTER. HI WILL MASK HD. DEFAULT = LO.
3V-OUTPUT PULSES CONTINUE IN SEQUENCE.
VDLEN
SYNC
VD
HD
SCP
XV1 TO XV24
0
5891-
085
Figure 68. Enhanced SYNC Mode 3
11
1
NOTES
1. VD-UPDATED REGISTERS (FOR EXAMPLE, PRIMARY_ACTION) ARE DISABLED DURING THE SYNC INTERVAL.
SYNC
VD
1VD REGISTERS ARE UPDATED HERE.
05
89
1-
0
86
Figure 69. Register Update Behavior
5
1FIELD DESIGNATOR IS INCREMENTED ON BOTH SYNC EDGES.
57
3
7
SYNC
VD
FIELD
DESIGNATOR
1
05
89
1-
08
7
Figure 70. Special SYNC Mode Effect on Field Designator
相關(guān)PDF資料
PDF描述
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參數(shù)描述
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