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參數(shù)資料
| 型號： | ZR36506 |
| 英文描述： | Fast Recovery Rectifier Diodes |
| 中文描述： | 外圍芯片 |
| 文件頁數(shù)： | 32/99頁 |
| 文件大?。?/td> | 452K |
| 代理商： | ZR36506 |
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Zoran ZR36506 USBV ision – Datasheet
Zoran Proprietary and Confidential
4-8
Register Bank ( Control and Status)
V ideo S etup and Control R egisters
Register
Address
Register
Name
Function
Default
Value
27
VIN_REG1
d2-d0: VIN_MODE Digital video input format.
d3:
VSNC_POL Vertical-Sync. Pulse
polarity.
d4:
HSNC_POL Horizontal-Sync. Pulse
polarity.
d5:
FID_POL Field Identity signal polarity.
d6:
d7:
HVALID_POL Pixel Envelope polarity.
VCLK_POL ('1'=data valid on up-going
clock).
AUTO_FID Auto Field Identity
generation. When set to '1', the
ZR36506 ignores the FID input from
camera, and generates an internal
toggling signal of its own instead.
NONE_INTERLACE Interlace/Non-
Interlace mode. If set to '1', all input
fields from the camera are processed,
otherwise odd fields are ignored.
00H
28
VIN_REG2
d0:
d1:
d2:
NO_HVALID If set to '1', HVALID
input ignored.
d3:
UV_ID If set to '1', use V7 pin as UV-id
('1'=U).
FIX_2C If set to '1', U7 & V7 are
inverted (2's comp).
d4:
d5:
SEND_FID- If set to '1',
Frame_Phase[0]=FID.
d6:
d7:
'0' reserved.
KEEP_BLANK - Set to '1' to drop
incoming frames.
00H
29
LXSIZE_IN
d7-d0: bits 7-0 of input video line length.
00H
30
MXSIZE_IN
d1-d0: bits 9-8 of input video line length.
d7-d2: '000000' reserved.
00H
31
LYSIZE_IN
d7-d0: bits 7-0 of input video number of lines.
00H
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| ZR36750 | Fast Recovery Rectifier Diodes |
| ZR37381GC-30 | Fast Recovery Rectifier Diodes |
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| ZR37381GC-45 | Fast Recovery Rectifier Diodes |
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參數(shù)描述 |
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