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參數(shù)資料
| 型號： | XCCACE-TQG144I |
| 廠商： | Xilinx Inc |
| 文件頁數(shù)： | 13/69頁 |
| 文件大小： | 0K |
| 描述： | IC ACE CONTROLLER CHIP TQ144 |
| 產(chǎn)品變化通告： | XCCACE-TQG144I Discontinuation 31/Oct/2011 |
| 標準包裝： | 60 |
| 控制器類型： | ACE 控制器 |
| 電源電壓： | 3 V ~ 3.6 V |
| 電流 - 電源： | 30mA |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 144-LQFP |
| 供應商設(shè)備封裝： | 144-TQFP（20x20） |
| 包裝： | 管件 |
| 其它名稱： | 122-1511-5 |
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System ACE CompactFlash Solution
20
DS080 (v3.0) April 7, 2014
Product Specification
R
— OBSOLETE — OBSOLETE — OBSOLETE — OBSOLETE —
Register Specification
The BYTE-mode register space of the MPU interface is shown in Table 8.
Table 8: Register Address Map (BYTE Mode Addresses)
BYTE Address
(MPA [6:0])
Register Name
Width
Mode
Description
0x00
BUSMODEREG
1
RW
Used to control the data bus access mode (8-bit
BYTE mode or 16-bit WORD mode)
0x01
BUSMODEREG
1
RW
0x02
--
Reserved
0x03
--
Reserved
0x04
STATUSREG(7:0)
8
R
Used to monitor System ACE CF controller status
0x05
STATUSREG(15:8)
8
R
0x06
STATUSREG(23:16)
8
R
0x07
STATUSREG(31:24)
8
R
0x08
ERRORREG(7:0)
8
R
Used to indicate any existing error condition
0x09
ERRORREG(15:8)
8
R
0x0A
ERRORREG(23:16)
8
R
0x0B
ERRORREG(31:24)
8
R
0x0C
CFGLBAREG(7:0)
8
R
Logical block address used by the Configuration
Controller during CompactFlash data transfers
0x0D
CFGLBAREG(15:8)
8
R
0x0E
CFGLBAREG(23:16)
8
R
0x0F
CFGLBAREG(27:24)
4
R
0x10
MPULBAREG(7:0)
8
RW
Logical block address used by the MPU interface
during CompactFlash data transfers
0x11
MPULBAREG(15:8)
8
RW
0x12
MPULBAREG(23:16)
8
RW
0x13
MPULBAREG(27:24)
4
RW
0x14
SECCNTCMDREG(7:0)
8
RW
Sector count and CompactFlash command
register
0x15
SECCNTCMDREG(15:8)
8
RW
0x16
VERSIONREG(7:0)
8
R
Version register
0x17
VERSIONREG(15:8)
8
R
0x18
CONTROLREG(7:0)
8
RW
Used to control System ACE CF controller
operations
0x19
CONTROLREG(15:8)
8
RW
0x1A
CONTROLREG(23:16)
8
RW
0x1B
CONTROLREG(31:24)
8
RW
0x1C
FATSTATREG(7:0)
8
R
Contains information about the FAT table of the first
valid partition found in the CompactFlash device.
0x1D
FATSTATREG(15:8)
8
R
0x1E through 0x3F
--
Reserved
Even Values
0x40 through 0x5E
DATABUFREG(7:0)
8
RW
Address range that provides read and write access
to the data buffer.
Odd Values
0x41 through 0x5F
DATABUFREG(15:8)
8
RW
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