參數(shù)資料
型號(hào)： TMS320C3X
元件分類： 數(shù)字信號(hào)處理
英文描述： 32-Bit Digital Signal Processor
中文描述： 32位數(shù)字信號(hào)處理器
文件頁數(shù)： 366/726頁
文件大小： 1771K
代理商： TMS320C3X
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Memory Map and Registers
12-9
Communication Ports
OUTPUT
LEVEL
Output FIFO Level
. Contents of this 4-bit field:
0000
2
(0): indicates an empty output FIFO.
0001
2
(1) through 0111
2
(7): indicates the number of full positions in the
output FIFO.
1111
2
(15): indicates a full output FIFO.
An empty output buffer (OUTPUT LEVEL = 0000
2
) sends an unlatched,
positive level-triggered interrupt (OCEMPTY = 1) to the CPU. When the CPU
or DMA coprocessor writes to the empty output FIFO, OCEMPTY is cleared
to 0 and remains in that state until the buffer is again empty. An output FIFO
with one or more empty levels also sends an unlatched, positive level-trig-
gered interrupt (OCRDY = 1) to the CPU and the DMA coprocessor. This
condition causes a READY/NOT READY signal to be generated when the
CPU or DMA coprocessor attempts to write to the output FIFO. See Section
12.6, Coordinating Communication Ports With the CPU and DMA Coproces-
sor on page 12-17, for details.
INPUT
LEVEL
Input FIFO level
. Contents of this 4-bit field:
0000
2
(0): indicates an empty input FIFO.
0001
2
(1) through 0111
2
(7): indicates the number of full positions in the input
FIFO.
1111
2
(15): indicates a full input FIFO.
A full input FIFO (INPUT LEVEL = 1111
2
) sends an unlatched, positive level-
triggered interrupt (ICFULL = 1) to the CPU. When the CPU or DMA
coprocessor reads from the full input FIFO, ICFULL is cleared to 0 and re-
mains in that state until the FIFO is again full. An input FIFO with one or more
full levels also an unlatched, positive level-triggered interrupt (ICRDY = 1)
to the CPU and the DMA coprocessor. This condition causes a READY/NOT
READY signal to be generated when the CPU or DMA coprocessor attempts
to read from the input FIFO.
Reserved
Undefined.
12.3.2 Input-Port Register
This read-only register contains the contents of position 0, the oldest value of
the input FIFO. If this register is written to, its contents remain unchanged.
Reading from an empty input FIFO causes the CPU or DMA operation to stall
and to halt the peripheral bus.
12.3.3 Output-Port Register
This write-only register interfaces to position 7 (the newest value) of the output
FIFO. If this register is read, its contents remain unchanged, and the value
read is undefined.
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PDF描述
TMS320C4X Digital Signal Processing Solutions
TMS320C6454GTZ7 Fixed-Point Digital Signal Processor
TMS320C6454GTZ Fixed-Point Digital Signal Processor
TMS320C6454GTZ8 Fixed-Point Digital Signal Processor
TMS320C6454ZTZ Fixed-Point Digital Signal Processor
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參數(shù)描述
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TMS320C40-40 制造商:未知廠家 制造商全稱:未知廠家 功能描述:32-Bit Digital Signal Processor
TMS320C40-50 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Digital Signal Processors
TMS320C40-60 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Digital Signal Processors
TMS320C40GFL40 功能描述:數(shù)字信號(hào)處理器和控制器 - DSP, DSC Digital Signal Proc RoHS:否 制造商:Microchip Technology 核心:dsPIC 數(shù)據(jù)總線寬度:16 bit 程序存儲(chǔ)器大小:16 KB 數(shù)據(jù) RAM 大小:2 KB 最大時(shí)鐘頻率:40 MHz 可編程輸入/輸出端數(shù)量:35 定時(shí)器數(shù)量:3 設(shè)備每秒兆指令數(shù):50 MIPs 工作電源電壓:3.3 V 最大工作溫度:+ 85 C 封裝 / 箱體:TQFP-44 安裝風(fēng)格:SMD/SMT
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