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參數(shù)資料
| 型號(hào)： | TMS320C3X |
| 元件分類： | 數(shù)字信號(hào)處理 |
| 英文描述： | 32-Bit Digital Signal Processor |
| 中文描述： | 32位數(shù)字信號(hào)處理器 |
| 文件頁數(shù)： | 30/726頁 |
| 文件大?。?/td> | 1771K |
| 代理商： | TMS320C3X |
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Figures
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Contents
11–10 Example of a Priority Wheel
11–11
Example of a Channel Priority Scheme in Split Mode
11–12 Service Sequence for Split Mode Priority Example
11–13 DMA Channel Running in Transfer Mode 102 (Autoinitialization Method 1a)
11–14 DMA Channel Running in Transfer Mode 102 (Autoinitialization Method 1b)
11–15 DMA Channel Running in Transfer Mode 112 (Autoinitialization Method 2a)
11–16 DMA Channel Running in Transfer Mode 112 (Autoinitialization Method 2b)
11–17 Store New Values of DMA Channel Registers in Memory (SPLIT MODE = 0)
11–18 Store New Values of DMA Channel Registers in Memory (SPLIT MODE = 1
and Transfer Counter = 0)
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11–19 Store New Values of DMA Channel Registers in Memory (SPLIT MODE = 1
and Auxiliary Transfer Counter = 0)
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11–20 DMA Channel Control Register Bits Modifiable by Autoinitialization in
Unified Mode
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11–21 DMA Channel Control Register Bit Modifiable by Autoinitialization of the
Primary Channel in Split Mode
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11–22 DMA Channel Control Register Bits That Can Be Modified by
Autoinitialization of the Auxiliary Channel in Split Mode
11–23 Self-Referential Link Pointer
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11–24 Referring to a New Link Pointer
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11–25 DIE Register Bit Functions for DMA Unified Mode
11–26 DIE Register Bit Functions for DMA Split Mode
11–27 No DMA Synchronization
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11–28 DMA Source Synchronization
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11–29 DMA Destination Synchronization
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11–30 Unified Mode DMA Source and Destination Synchronization
11–31 Timing and Number of Cycles for DMA Transfers to On-Chip Destination
11–32 Timing and Number of Cycles for DMA Transfers to a Local-Bus Destination
11–33 Timing and Number of Cycles for DMA Transfers to a Global-Bus Destination
11–34 Unified-Mode DMA Timing for Different Synchronizations
11–35 Split-Mode DMA Timing for Different Synchronizations
12–1
Communication Port Block Diagram
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
12–2
’C4x Communication-Port Interface-Connection Example
12–3
Communication-Port Memory Map
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12–4
Communication-Port Control Register (CPCR)
12–5
Communication-Port Arbitration-Unit State Diagram
12–6
Token Transfer Operation
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12–7
Word Transfer Operation
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12–8
Type-One Synchronizer Minimum Delay
12–9
Type-One Synchronizer Maximum Delay
12–10 Type-Two Synchronizer Minimum Delay
12–11 Type-Two Synchronizer Maximum Delay
12–12 Type-Three Synchronizer Minimum Delay
12–13 Type-Three Synchronizer Maximum Delay
12–14 Post-Reset State for an Output Port
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| TMS320C40-60 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Digital Signal Processors |
| TMS320C40GFL40 | 功能描述:數(shù)字信號(hào)處理器和控制器 - DSP, DSC Digital Signal Proc RoHS:否 制造商:Microchip Technology 核心:dsPIC 數(shù)據(jù)總線寬度:16 bit 程序存儲(chǔ)器大小:16 KB 數(shù)據(jù) RAM 大小:2 KB 最大時(shí)鐘頻率:40 MHz 可編程輸入/輸出端數(shù)量:35 定時(shí)器數(shù)量:3 設(shè)備每秒兆指令數(shù):50 MIPs 工作電源電壓:3.3 V 最大工作溫度:+ 85 C 封裝 / 箱體:TQFP-44 安裝風(fēng)格:SMD/SMT |
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