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參數(shù)資料
| 型號(hào)： | TMS320C3X |
| 元件分類(lèi)： | 數(shù)字信號(hào)處理 |
| 英文描述： | 32-Bit Digital Signal Processor |
| 中文描述： | 32位數(shù)字信號(hào)處理器 |
| 文件頁(yè)數(shù)： | 23/726頁(yè) |
| 文件大?。?/td> | 1771K |
| 代理商： | TMS320C3X |
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Contents
xx
7.2
Delayed Branches
7.2.1
Delayed Branches Without Annulling
7.2.2
Delayed Branches With Annulling
Calls, Traps, Branches, Jumps, and Returns
Interrupts
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
7.4.1
Interrupt Vector Table and Prioritization
7.4.2
CPU Interrupt Control Bits
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
7.4.3
Interrupt Processing
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
7.4.4
CPU Interrupt Latency
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
7.4.5
External Interrupts
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
Traps
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
7.5.1
Initialization of Traps and Interrupts
7.5.2
Operation of Traps
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
7.5.3
Overlapping the Trap and Interrupt Vector Tables
DMA Interrupts
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
7.6.1
DMA Interrupt Control Bits
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
7.6.2
DMA Interrupt Processing
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
7.6.3
CPU/DMA Interrupt Interaction
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
Reset
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
7.7.1
Reset’s Effects on Pin States
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
7.7.2
Reset Vector Location
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
7.7.3
Additional Reset Operations
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
7-9
7-10
7-11
7-12
7-15
7-15
7-17
7-18
7-20
7-21
7-24
7-24
7-24
7-25
7-26
7-26
7-27
7-28
7-29
7-29
7-35
7-35
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
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. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
7.3
7.4
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
7.5
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
. . . . . . . . . . . . . . . . . . . . . . .
7.6
7.7
8
Pipeline Operation
Describes and explains the operation of the four pipeline stages in the ’C4x CPU
8.1
Pipeline Structure
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
8.2
Pipeline Conflicts
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8.2.1
Branch Conflicts
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8.2.2
Register Conflicts
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8.2.3
Memory Conflicts
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8.3
Memory Accesses for Maximum Performance
8.4
Clocking of Memory Accesses
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
8.4.1
Program Fetches
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
8.4.2
Data Loads and Stores
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8-1
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8-4
8-4
8-8
8-10
8-17
8-19
8-19
8-20
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9
External Bus Operation
Describes the features and functions of the two ’C4x external buses
9.1
Overview
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9.2
Memory Interface Signals
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
9.3
Memory-Interface Control Registers
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
9.3.1
Mapping Addresses to Strobes
9.3.2
Page Size Operation
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
9.4
Programmable Wait States
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9.5
Memory Interface Timing
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9-1
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相關(guān)PDF資料 |
PDF描述 |
|---|---|
| TMS320C4X | Digital Signal Processing Solutions |
| TMS320C6454GTZ7 | Fixed-Point Digital Signal Processor |
| TMS320C6454GTZ | Fixed-Point Digital Signal Processor |
| TMS320C6454GTZ8 | Fixed-Point Digital Signal Processor |
| TMS320C6454ZTZ | Fixed-Point Digital Signal Processor |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| TMS320C40 | 制造商:TI 制造商全稱:Texas Instruments 功能描述:DIGITAL SIGNAL PROCESSOR |
| TMS320C40-40 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:32-Bit Digital Signal Processor |
| TMS320C40-50 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Digital Signal Processors |
| TMS320C40-60 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Digital Signal Processors |
| TMS320C40GFL40 | 功能描述:數(shù)字信號(hào)處理器和控制器 - DSP, DSC Digital Signal Proc RoHS:否 制造商:Microchip Technology 核心:dsPIC 數(shù)據(jù)總線寬度:16 bit 程序存儲(chǔ)器大小:16 KB 數(shù)據(jù) RAM 大小:2 KB 最大時(shí)鐘頻率:40 MHz 可編程輸入/輸出端數(shù)量:35 定時(shí)器數(shù)量:3 設(shè)備每秒兆指令數(shù):50 MIPs 工作電源電壓:3.3 V 最大工作溫度:+ 85 C 封裝 / 箱體:TQFP-44 安裝風(fēng)格:SMD/SMT |
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