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參數(shù)資料
| 型號(hào)： | ST72321BM |
| 廠商： | 意法半導(dǎo)體 |
| 英文描述： | 80-PIN 8-BIT MCU WITH 32 TO 60K FLASH/ROM, ADC, FIVE TIMERS, SPI, SCI, I2C INTERFACE(具有ICP,IAP,Nested Interrupt,TLI,ROP的8位MCU) |
| 中文描述： | 80引腳8位微控制器32至60,000閃存/ ROM，ADC的，5個(gè)定時(shí)器，SPI和SCI的I2C接口（具有比較方案，國際檢察官聯(lián)合會(huì)，嵌套中斷，中華語文研習(xí)所，人事登記的8位微控制器） |
| 文件頁數(shù)： | 152/178頁 |
| 文件大小： | 3121K |
| 代理商： | ST72321BM |
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ST72F321M, ST72321BM
152/178
11.8 I/O PORT PIN CHARACTERISTICS
11.8.1 General Characteristics
Subject to general operating conditions for V
DD
, f
OSC
, and T
A
unless otherwise specified.
Figure 78. Unused I/O Pins configured as input
Figure 79. Typical I
PU
vs. V
DD
with V
IN
=V
SS
90
Notes:
1. Data based on characterization results, not tested in production.
2.
Hysteresis voltage between Schmitt trigger switching levels. Based on characterization results, not tested.
3. When the current limitation is not possible, the V
maximum must be respected, otherwise refer to I
specifica-
tion. A positive injection is induced by V
IN
>V
DD
while a negative injection is induced by V
IN
<V
SS
. Refer to
section 11.2.2
on page 135
for more details.
4.
Configuration not recommended, all unused pins must be kept at a fixed voltage: using the output mode of the I/O for
example and leaving the I/O unconnected on the board or an external pull-up or pull-down resistor (see
Figure 78
). Data
based on design simulation and/or technology characteristics, not tested in production.
5. The R
PU
pull-up equivalent resistor is based on a resistive transistor (corresponding I
PU
current characteristics de-
scribed in
Figure 79
).
6. To generate an external interrupt, a minimum pulse width has to be applied on an I/O port pin configured as an external
interrupt source.
Symbol
V
IL
V
IH
V
hys
V
IL
V
IH
V
hys
Parameter
Conditions
Min
Typ
Max
0.3xV
DD
Unit
Input low level voltage
1)
Input high level voltage
1)
Schmitt trigger voltage hysteresis
2)
Input low level voltage
1)
Input high level voltage
1)
Schmitt trigger voltage hysteresis
2)
Injected Current on PC6 (Flash de-
vices only)
Injected Current on an I/O pin
Σ
I
INJ(PIN)3)
Total injected current (sum of all I/O
and control pins)
I
L
Input leakage current
I
S
Static current consumption
R
PU
C
IO
I/O pin capacitance
t
f(IO)out
t
r(IO)out
t
w(IT)in
CMOS ports
V
0.7xV
DD
0.7
TTL ports
0.8
2
1
I
INJ(PIN)3)
V
DD
=5V
0
+4
mA
± 4
± 25
V
SS
≤
V
IN
≤
V
DD
Floating input mode
4)
V
IN
=
V
SS
±1
μ
A
400
120
5
25
25
Weak pull-up equivalent resistor
5)
V
DD
=5V
50
250
k
pF
Output high to low level fall time
1)
Output low to high level rise time
1)
External interrupt pulse time
6)
C
L
=50pF
Between 10% and 90%
ns
1
t
CPU
10k
UNUSED I/O PORT
ST7XXX
10k
UNUSED I/O PORT
ST7XXX
V
DD
Note
: I/O can be left unconnected if it is configured as output
(0 or 1) by the software. This has the advantage of
greater EMC robustness and lower cost.
0
10
20
30
40
50
60
70
80
2
2.5
3
3.5
4.5
5
5.5
6
V d4
I
Ta=1 40°C
Ta=9 5°C
Ta=2 5°C
Ta=-45 °C
相關(guān)PDF資料 |
PDF描述 |
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