參數(shù)資料
型號: ST10F252M-4T3
廠商: STMICROELECTRONICS
元件分類: 微控制器/微處理器
英文描述: 16-BIT, FLASH, 40 MHz, RISC MICROCONTROLLER, PQFP100
封裝: 14 X 14 MM, 1.40 MM HEIGHT, 0.50 MM PITCH, ROHS COMPLIANT, LQFP-100
文件頁數(shù): 310/328頁
文件大?。?/td> 3111K
代理商: ST10F252M-4T3
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General purpose timer unit
ST10F252M
11
General purpose timer unit
The general purpose timer (GPT) unit is a flexible multifunctional timer/counter structure
which is used for time related tasks such as event timing and counting, pulse width and duty
cycle measurements, pulse generation, or pulse multiplication. The GPT unit contains five
16-bit timers organized into two separate modules GPT1 and GPT2. Each timer in each
module may operate independently in several different modes, or may be concatenated with
another timer of the same module.
11.1
GPT1
Each of the three timers T2, T3, T4 of the GPT1 module can be configured individually for
one of four basic modes of operation:
1.
timer
2.
gated timer
3.
counter mode
4.
incremental interface mode.
Although due to pins limitation in ST10F252 not all modes are available for each timer.
In timer mode, the input clock for a timer is derived from the CPU clock, divided by a
programmable prescaler, Each of the three timers T2, T3, T4 of the GPT1 module can be
configured in this mode.
In counter mode, the timer is clocked by reference to external events. Pulse width or duty
cycle measurement is supported in gated timer mode where the operation of a timer is
controlled by the ‘gate’ level on an external input pin. For these purposes, timers have one
associated port pin (TxIN) which serves as gate or clock input. Only T2 and T3 have such an
input pin associated in ST10F252, so gated timer and counter mode are not available for
timer T4.
The count direction (up/down) for each timer is programmable only by software.
Functionality that dynamically changes direction by an external signal on a port pin is not
available on ST10F252. For the same reason, incremental interface mode is not available
for all the GPT1 timers (T2, T3, T4).
Timer T3 has output toggle latches (TxOTL) which changes state on each timer over-
flow/underflow. The state of this latch may be used internally to clock timers T2 and T4 for
measuring long time periods with high resolution.
In addition to their basic operating modes, timers T2 and T4 may be configured as reload or
capture registers for timer T3. When used as capture or reload registers, timers T2 and T4
are stopped. The contents of timer T3 is captured into T2 or T4 in response to a signal at
their associated input pins (TxIN). Timer T3 is reloaded with the contents of T2 or T4
triggered either by an external signal or by a selectable state transition of its toggle latch
T3OTL. When both T2 and T4 are configured to alternately reload T3 on opposite state
transitions of T3OTL with the low and high times of a PWM signal, this signal can be
constantly generated without software intervention.
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PDF描述
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