參數(shù)資料
型號： SPAK56854FG120
廠商： FREESCALE SEMICONDUCTOR INC
元件分類： 數(shù)字信號處理
英文描述： 16-BIT, 4 MHz, OTHER DSP, PQFP128
封裝： LQFP-128
文件頁數(shù)： 604/649頁
文件大?。?/td> 7965K
代理商： SPAK56854FG120
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MOTOROLA
DSP56853/854/855/857/858 User’s Manual
Index - 5
Preliminary
G
Gated Count Mode TMR 13-7
General Information TOD 14-6
General Purpose I/O Port (GPIO) 1-31
GPIO A-7
(General Purpose Input/Output) 1-31
Block Diagram 15-5
Configuration 15-8
Data Register Access 15-25
Features 15-3
Functional Description 15-7
GPIO Mode 15-7
Interrupts 15-25
Memory Maps 15-3
Modes of Operation 15-7
Normal Mode 15-7
Port A Data Register (MPA_DR) 15-17
Port A Direction Register (MPA_DDR) 15-12
Port A Peripheral Enable Register
(MPA_PER) 15-8
Port A Pull-Up Enable Register (MPA_PUE) 15-21
Port B Data Register (MPB_DR) 15-17
Port B Direction Register (MPB_DDR) 15-13
Port B Peripheral Enable Register
(MPB_PER) 15-9
Port B Pull-Up Enable Register (MPB_PUE) 15-21
Port C Data Register (MPC_DR) 15-18
Port C Direction Register (MPC_DDR) 15-13
Port C Peripheral Enable Register
(MPC_PER) 15-9
Port C Pull-Up Enable Register (MPC_PUE) 15-22
Port D Data Register (MPD_DR) 15-18
Port D Direction Register (MPD_DDR) 15-14
Port D Peripheral Enable Register
(MPD_PER) 15-10
Port D Pull-Up Enable Register (MPD_PUE) 15-22
Port E Data Register (MPE_DR) 15-19
Port E Direction Register (MPE_DDR) 15-14
Port E Peripheral Enable Register
(MPE_PER) 15-10
Port E Pull-Up Enable Register (MPE_PUE) 15-23
Port F Data Register (MPF_DR) 15-19
Port F Direction Register (MPF_DDR) 15-15
Port F Peripheral Enables Register
(MPF_PER) 15-11
Port F Pull-Up Enable Register (MPF_PUE) 15-23
Port G Data Register (MPG_DR) 15-20
Port G Direction Register (MPG_DDR) 15-16
Port G Peripheral Enables Register
(MPG_PER) 15-11
Port G Pull-Up Enable Register (MPG_PUE) 15-24
Port H Data Register (MPH_DR) 15-20
Port H Direction Register (MPH_DDR) 15-16
Port H Peripheral Enables Register
(MPH_PER) 15-12
Port H Pull-Up Enable Register (MPH_PUE) 15-24
Register Descriptions 15-8
Register Map GPIO A 15-3
Register Map GPIO B 15-3
Register Map GPIO C 15-4
Register Map GPIO D 15-4
Register Map GPIO E 15-4
Register Map GPIO F 15-4
Register Map GPIO G 15-5
Resets 15-25
GPR A-7
H
Harvard architecture A-7
HBO A-7
HI8
Block Diagram 16-7
DSP Core Interrupts 16-15
DSP Side Features 16-3
DSP Side HI8 Control Register (HCR) 16-9
DSP Side HI8 Receive Data Register (HRX) 16-14
DSP Side HI8 Register Descriptions 16-8
DSP Side HI8 Status Register (HSR) 16-12
DSP Side HI8 Transmit Data Register (HTX) 16-14
DSP Side Registers After Reset 16-15
Features 16-3
Host Port 16-5
Host Port Use Considerations 16-33
Host Processor Data Transfer 16-28
Host Side Command Vector Register (CVR) 16-22
Host Side DMA Mode Operation 16-30
Host Side Features 16-4
Host Side HI8 Register Descriptions 16-8
Host Side Interface Control Register (ICR) 16-18
Host Side Interface Status Register (ISR) 16-23
Host Side Interrupt Vector Register (IVR) 16-26
Host Side Polling 16-28
Host Side Receive Byte Registers (RXH,
RXL) 16-26
Host Side Registers 16-16
Host Side Registers After Reset 16-27
Host Side Transmit Byte Registers (TXH,
TXL) 16-27
Servicing Interrupts Host Side 16-29
Servicing the Host Interface 16-23
Signal Desctiptions 16-5
HLMTI A-7
相關(guān)PDF資料
PDF描述
SPAK56F802TA60 0-BIT, 60 MHz, OTHER DSP, PQFP32
SPAK56F805FV80 16-BIT, 8 MHz, OTHER DSP, PQFP144
SPAK56F807VF80 16-BIT, 80 MHz, OTHER DSP, PBGA160
SPAK56F807VF80 16-BIT, 80 MHz, OTHER DSP, PBGA160
SPAK56F826BU80 16-BIT, 80 MHz, OTHER DSP, PQFP100
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參數(shù)描述
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SPAK56F803BU80 制造商:Freescale Semiconductor 功能描述:
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SPAKDSP303AG100 功能描述:數(shù)字信號處理器和控制器 - DSP, DSC SPAKDSP303AG100 RoHS:否 制造商:Microchip Technology 核心:dsPIC 數(shù)據(jù)總線寬度:16 bit 程序存儲器大小:16 KB 數(shù)據(jù) RAM 大小:2 KB 最大時鐘頻率:40 MHz 可編程輸入/輸出端數(shù)量:35 定時器數(shù)量:3 設(shè)備每秒兆指令數(shù):50 MIPs 工作電源電壓:3.3 V 最大工作溫度:+ 85 C 封裝 / 箱體:TQFP-44 安裝風(fēng)格:SMD/SMT
SPAKDSP303GC100 制造商:Motorola Inc 功能描述:
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