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參數(shù)資料
| 型號： | SPAK56854FG120 |
| 廠商： | FREESCALE SEMICONDUCTOR INC |
| 元件分類： | 數(shù)字信號處理 |
| 英文描述： | 16-BIT, 4 MHz, OTHER DSP, PQFP128 |
| 封裝： | LQFP-128 |
| 文件頁數(shù)： | 371/649頁 |
| 文件大?。?/td> | 7965K |
| 代理商： | SPAK56854FG120 |
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Introduction
MOTOROLA
JTAG Port
17-3
Preliminary
17
17.1 Introduction
This chapter describes the DSP56F800E core-based family of chips, providing board and
chip-level debugging and high-density circuit board testing specific to Joint Test Action
Group (JTAG).
The DSP56853/854/855/857/858 provides board and chip-level testing capability through
two on-chip modules, both accessed through the JTAG port/EOnCE module interface:
Enhanced On-chip Emulation (EOnCE) module
Test Access Port (TAP) and 16-state controller, also known as the JTAG port
Presence of the JTAG port/EOnCE module interface permits insertion of the DSP chip
into a target system while retaining debug control. This capability is especially important
for devices without an external bus, because it eliminates the need for a costly cable to
bring out the footprint of the chip required by a traditional emulator system.
The Enhanced OnCE (EOnCE) module is a Motorola-designed module used in Digital
Signal Processor (DSP) chips to debug application software employed with the chip. The
port is a separate on-chip block allowing non-intrusive DSP interaction with accessibility
through the pins of the JTAG interface. The EOnCE module makes it possible to examine
registers, memory, or on-chip peripherals’ contents in a special debug environment. This
avoids sacrificing any user-accessible, on-chip resources to perform debugging
procedures. Please refer to DSP56F800E Core-Based Reference Manual for details about
implementation of the DSP5685x EOnCE module.
The JTAG port is a dedicated user-accessible TAP compatible with the IEEE
1149.1a-1993 Standard Test Access Port and Boundary Scan Architecture. Problems
associated with testing high-density circuit boards have led to the development of this
proposed standard under the sponsorship of the Test Technology Committee of IEEE and
the JTAG. DSP5685x supports circuit board test strategies based on this standard.
Six dedicated pins interface to the TAP containing a 16-state controller. The TAP uses a
boundary scan technique to test the interconnections between integrated circuits after they
are assembled onto a Printed Circuit Board (PCB). Boundary scans allow observation and
control signal levels at each component pin through a Shift register placed next to each
pin. This is important for testing continuity and determining if pins are stuck at a one or
zero level.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| SPAK56F802TA60 | 0-BIT, 60 MHz, OTHER DSP, PQFP32 |
| SPAK56F805FV80 | 16-BIT, 8 MHz, OTHER DSP, PQFP144 |
| SPAK56F807VF80 | 16-BIT, 80 MHz, OTHER DSP, PBGA160 |
| SPAK56F807VF80 | 16-BIT, 80 MHz, OTHER DSP, PBGA160 |
| SPAK56F826BU80 | 16-BIT, 80 MHz, OTHER DSP, PQFP100 |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| SPAK56857BU120 | 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:120 MIPS Hybrid Processor |
| SPAK56F803BU80 | 制造商:Freescale Semiconductor 功能描述: |
| SPAK56F805FV80 | 制造商:Freescale Semiconductor 功能描述: |
| SPAKDSP303AG100 | 功能描述:數(shù)字信號處理器和控制器 - DSP, DSC SPAKDSP303AG100 RoHS:否 制造商:Microchip Technology 核心:dsPIC 數(shù)據(jù)總線寬度:16 bit 程序存儲器大小:16 KB 數(shù)據(jù) RAM 大小:2 KB 最大時鐘頻率:40 MHz 可編程輸入/輸出端數(shù)量:35 定時器數(shù)量:3 設(shè)備每秒兆指令數(shù):50 MIPs 工作電源電壓:3.3 V 最大工作溫度:+ 85 C 封裝 / 箱體:TQFP-44 安裝風格:SMD/SMT |
| SPAKDSP303GC100 | 制造商:Motorola Inc 功能描述: |
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