參數(shù)資料
型號： SPAK56854FG120
廠商： FREESCALE SEMICONDUCTOR INC
元件分類： 數(shù)字信號處理
英文描述： 16-BIT, 4 MHz, OTHER DSP, PQFP128
封裝： LQFP-128
文件頁數(shù)： 234/649頁
文件大?。?/td> 7965K
代理商： SPAK56854FG120
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Register Descriptions (ESSI0_BASE = $1FFE20, ESSI1_BASE = $1FFE00)
MOTOROLA
Enhanced Synchronous Serial Interface (ESSI)
12-39
Preliminary
12
12.7.8.5 Transmit Enable 0 (TE0)—Bit 12
This control bit enables the transfer of the contents of the STX0 register to its Transmit
Data Shift Register 0 (TXSR0). TE0 is functional when the ESSI is in either Synchronous
or Asynchronous modes.
0 = The transmitter continues to send the data currently in TXSR0, then disables the
transmitter.
1 = On the next frame boundary, the transmit 0 portion of the ESSI is enabled. With
internally generated clocks, the frame boundary will occur within a word time.
If the TE0 bit is cleared, then set again during the same transmitted word, the
data continues to be transmitted. If the TE0 bit is set again during a different
time slot, data is not transmitted until the next frame boundary.
The serial output is tri-stated and any data present in the STX0 register is not transmitted.
For example, data can be written to the STX0 register with the TE0 bit cleared and the
TDE bit is cleared, but data is not transferred to the TXSR0.
The normal transmit enable sequence is to write data to the STX0 register or to the STSR
before setting the TE0 bit. The normal transmit disable sequence is to clear both the TE0
and TIE bits after the TDE bit is set. This bit should be cleared when clearing ESSIEN.
12.7.8.6 Transmit Enable 1 (TE1)—Bit 11
This control bit enables the transfer of the contents of the STX1 register to its Transmit
Data Shift Register 1 (TXSR1). TE1 is functional when the ESSI is in the Synchronous
mode. It is ignored when the ESSI is in the Asynchronous mode.
0 = The transmitter continues to send the data currently in TXSR1, then disables the
transmitter. The serial output is tri-stated and any data present in the STX1
register is not transmitted. In other words, data can be written to the STX1
register with the TE1 bit cleared, and the TDE bit is cleared but data is not
transferred to the TXSR1.
1 = On the next frame boundary, the transmit 1 portion of the ESSI is enabled for
that frame. With internally generated clocks, the frame boundary will occur
within a word time. If the TE1 bit is cleared and then set again during the same
transmitted word, the data continues to be transmitted. If the TE1 bit is set again
during a different time slot, data is not transmitted until the next frame
boundary.
When the TE1 bit remains clear until the beginning of the next frame, it causes the SC0
signal to act as a serial I/O flag from the start of the frame in both Normal and Network
modes.
相關(guān)PDF資料
PDF描述
SPAK56F802TA60 0-BIT, 60 MHz, OTHER DSP, PQFP32
SPAK56F805FV80 16-BIT, 8 MHz, OTHER DSP, PQFP144
SPAK56F807VF80 16-BIT, 80 MHz, OTHER DSP, PBGA160
SPAK56F807VF80 16-BIT, 80 MHz, OTHER DSP, PBGA160
SPAK56F826BU80 16-BIT, 80 MHz, OTHER DSP, PQFP100
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參數(shù)描述
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SPAK56F803BU80 制造商:Freescale Semiconductor 功能描述:
SPAK56F805FV80 制造商:Freescale Semiconductor 功能描述:
SPAKDSP303AG100 功能描述:數(shù)字信號處理器和控制器 - DSP, DSC SPAKDSP303AG100 RoHS:否 制造商:Microchip Technology 核心:dsPIC 數(shù)據(jù)總線寬度:16 bit 程序存儲器大小:16 KB 數(shù)據(jù) RAM 大小:2 KB 最大時鐘頻率:40 MHz 可編程輸入/輸出端數(shù)量:35 定時器數(shù)量:3 設(shè)備每秒兆指令數(shù):50 MIPs 工作電源電壓:3.3 V 最大工作溫度:+ 85 C 封裝 / 箱體:TQFP-44 安裝風(fēng)格:SMD/SMT
SPAKDSP303GC100 制造商:Motorola Inc 功能描述:
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