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參數(shù)資料
| 型號： | SPAK56854FG120 |
| 廠商： | FREESCALE SEMICONDUCTOR INC |
| 元件分類： | 數(shù)字信號處理 |
| 英文描述： | 16-BIT, 4 MHz, OTHER DSP, PQFP128 |
| 封裝： | LQFP-128 |
| 文件頁數(shù)： | 206/649頁 |
| 文件大?。?/td> | 7965K |
| 代理商： | SPAK56854FG120 |
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12-14
DSP56853/854/855/857/858 User’s Manual
MOTOROLA
Preliminary
Functional Description
12
12.5.2 Network Mode
Network mode is used for creating a Time Division Multiplexed (TDM) network, such as
a TDM codec network or a network of DSPs. This mode only operates with continuous
clock mode. A frame sync occurs at the beginning of each frame. In this mode, the frame
is divided into more than one time slot. During each time slot, one data word can be
transferred. Each time slot is then assigned to an appropriate codec or DSP on the network.
The DSP can be a master device controlling its own private network, or a slave device
connected to an existing TDM network, occupying a few time slots.
The frame sync signal indicates the beginning of a new data frame. Each data frame is
divided into time slots and transmission and/or reception of one data word can occur in
each time slot (rather than in just the frame sync time slot as in the Normal mode). The
frame rate dividers, controlled by the DC bit field, select two to thirty-two time slots per
frame. The length of the frame is determined by these factors:
The period of the serial bit clock (PSR, PM[7:0] bits for internal clock, or the
frequency of the external clock on the SCK and/or SC0 pins)
The number of bits per sample (WL) bits
The number of time slots per frame (DC) bit fields
Data can be transmitted in any time slot while in the Network mode. The distinction of the
Network mode is, each time slot is identified with respect to the frame sync (data word
time). This time slot identification allows the option of transmitting data during the time
slot by writing to the STX register or ignoring the time slot by writing to STSR. The
receiver is treated in the same manner, except data is always being shifted into the RXSR
and transferred to the SRX register. The core reads the SRX register, either using the data
or discarding it.
Figure 12-4 and Figure 12-5 provide sample timing of Network mode transfers. The
figures illustrate Receive and Transmit frames of five time-slots for each. The numbered
circles and arrows in the figure identify discussion notes contained in Table 12-8 and
12.5.2.1 Network Mode Transmit
The transmit portion of the ESSI is enabled when the ESSIEN and the TE bits in the SCR2
are both set. However, when the TE bit is set, the transmitter is enabled only after
detection of a new frame boundary. Software has to find the start of the next frame by
checking the TFS bit of the SSR. A normal start-up sequence for transmission is to do the
following:
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| SPAK56F802TA60 | 0-BIT, 60 MHz, OTHER DSP, PQFP32 |
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| SPAK56F807VF80 | 16-BIT, 80 MHz, OTHER DSP, PBGA160 |
| SPAK56F807VF80 | 16-BIT, 80 MHz, OTHER DSP, PBGA160 |
| SPAK56F826BU80 | 16-BIT, 80 MHz, OTHER DSP, PQFP100 |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
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| SPAK56F805FV80 | 制造商:Freescale Semiconductor 功能描述: |
| SPAKDSP303AG100 | 功能描述:數(shù)字信號處理器和控制器 - DSP, DSC SPAKDSP303AG100 RoHS:否 制造商:Microchip Technology 核心:dsPIC 數(shù)據(jù)總線寬度:16 bit 程序存儲器大小:16 KB 數(shù)據(jù) RAM 大小:2 KB 最大時(shí)鐘頻率:40 MHz 可編程輸入/輸出端數(shù)量:35 定時(shí)器數(shù)量:3 設(shè)備每秒兆指令數(shù):50 MIPs 工作電源電壓:3.3 V 最大工作溫度:+ 85 C 封裝 / 箱體:TQFP-44 安裝風(fēng)格:SMD/SMT |
| SPAKDSP303GC100 | 制造商:Motorola Inc 功能描述: |
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