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參數(shù)資料
| 型號： | SIS300 |
| 廠商： | SILICON INTEGRATED SYSTEMS CORP |
| 元件分類： | 圖形處理器 |
| 英文描述： | GRAPHICS PROCESSOR, PBGA365 |
| 封裝： | 27 X 27 MM, BGA-365 |
| 文件頁數(shù)： | 87/115頁 |
| 文件大小： | 2426K |
| 代理商： | SIS300 |
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SiS300 2D/3D/Video/DVD Accelerator
Preliminary V0.3 March 23, 1999
65
Silicon Integrated Systems Corporation
DAC index is incremented in case the value for the next DAC index to be
read.
When SR7 D2 = 0
D[7:0]
DAC Data [7:0]
When SR7 D2 = 0, the 24-bit LUT is enabled. This LUT can translate the R,
G, B values into new R, G, B values independently. This LUT can be used
for performing GAMMA correction function. The programming procedure is
same as standard LUT when SR7 D2 = 1.
5.6.5
PEL MASK REGISTER
Register Type: Read/Write
Read/Write Port:
3C6
Default:
00h
D[7:0]
Pixel Mask Bit[7:0]
This field is the Pixel Mask for the palette DAC.
If a bit in this field is
programmed to '0', the corresponding bit in the pixel data will be ignored in
looking up an entry in the LUT.
5.7
EXTENDED REGISTERS
Register Type: Read/Write
Read/Write Port:
3C4
Default:
00h
D[7:6]
Reserved
D[5:0]
Extended Register Index Bit[5:0] (05h ~ 3Fh)
Table 5.7-1 Table of Extended Registers
INDEX (3C4)
EXTENDED ENHANCED REGISTER (3C5)
05h
Extended Password/Identification Register
06h
Extended graphics mode register
07h
RAMDAC control register
08h
CRT threshold register I
09h
CRT threshold register II
0Ah
Extended vertical overflow register
0Bh
Extended horizontal overflow register I
0Ch
Extended horizontal overflow register II
0Dh
Extended CRT starting address register
0Eh
Extended CRT pitch register
相關(guān)PDF資料 |
PDF描述 |
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| SK12439PJT | 800 MHz, OTHER CLOCK GENERATOR, PQCC28 |
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| SL15100ZCT-XXX | 200 MHz, OTHER CLOCK GENERATOR, PDSO8 |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
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