參數(shù)資料
型號： ORSO42G5-EV
廠商： Lattice Semiconductor Corporation
文件頁數(shù)： 113/153頁
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描述： BOARD EVAL DEV PLATFORM ORSO42G5
標(biāo)準(zhǔn)包裝： 1
系列： ORCA® 4 系列
類型： FPGA
適用于相關(guān)產(chǎn)品： ORSO42G5
所含物品： 板，線纜，電源
其它名稱： ORSO42G5EV
Lattice Semiconductor
ORCA ORSO42G5 and ORSO82G5 Data Sheet
62
Signal Description for RX Path (SERDES Core to FPGA) – ORSO42G5
Signals are divided across four channels with 40 signals per channel. RXDxx[39:0] is the set of 40 signals for a
channel xx.
All RX direction signals are outputs from the core.
See Figure 47 for clock transfers across the FPGA/Core interface.
In SONET mode, RXDxx[31:0] carries 32 bit data from the alignment FIFO of the respective channel.
RXDxx[35:32] carries miscellaneous information such as OOF, BIPERR, Frame Pulse (FP), and SPE.
In cell mode, data from each of the four 2-link IPC bundles are spread across all eight channels and are assigned
to the 20 LSBs (RXDxx[19:0]) of each channel output. Data from IPC2_A1 is distributed across RXDAA[19:0]
and RXDAB[19:0]. Data from IPC2_A2 is distributed across RXDAC[19:0] and RXDAD[19:0]. This symmetry is
maintained for IPC2 data signals from block B.
The IPC status signals for Cell Mode operation are contained in RXDxx[39:36] and RXDxx[33].
The signals for SONET Mode operation are assigned to RXDxx[35:34] and RXDxx[33].
[39:33]
—
32
DINAD_FP
—
[31:21]
DINAD[31:21]
—
20
DINAD[20]
—
OPC8_CELLVALID
[19:0]
DINAD[19:0]
OPC2_A2[19:0]
OPC8[99:80]
TXDBA
SONET Mode
OPC2 B1 Mode
OPC8 Mode
[39:33]
—
32
DINBA_FP
—
[31:21]
DINBA[31:21]
—
20
DINBA[20]
OPC2_B1_CELLVALID
—
[19:0]
DINBA[19;0]]
OPC2_B1[39:20]
OPC8[79:60]
TXDBB
SONET Mode
OPC2 B1 Mode
OPC8 Mode
[39:33]
—
32
DINBB_FP
—
[31:20]
DINBB[31:20]
—
[19:0]
DINBB[19:0]
OPC2_B1[19:0]
OPC8[59:40]
TXDBC
SONET Mode
OPC2 B2 Mode
OPC8 Mode
[39:33]
—
32
DINBC_FP
—
[31:21]
DINBC[31:21]
—
20
DINBC[20]
OPC2_B2_CELLVALID
—
[19:0]
DINBC[19:0]
OPC2_B2[39:20]
OPC8[39:20]
TXDBD
SONET Mode
OPC2 B2 Mode
OPC8 Mode
[39:33]
—
32
DINBD_FP
—
[31:20]
DINBD[31:20]
—
[19:0]
DINBD[19:0]
OPC2_B2[19:0]
OPC8[19:0]
Table 12. TX FPGA/Core Interface Signaling – ORSO82G5 (Continued)
相關(guān)PDF資料
PDF描述
EEM22DTAT-S189 CONN EDGECARD 44POS R/A .156 SLD
ECC20DRES CONN EDGECARD 40POS .100 EYELET
AT-S-26-4/4/W-25-R MOD CORD STANDARD 4-4 WHITE 25'
EEC40DREI CONN EDGECARD 80POS .100 EYELET
0210490869 CABLE JUMPER 1.25MM .203M 17POS
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
ORSO82G5 制造商:LATTICE 制造商全稱:Lattice Semiconductor 功能描述:0.6 to 2.7 Gbps SONET Backplane Interface FPSCs
ORSO82G5-1BM680C 功能描述:FPGA - 現(xiàn)場可編程門陣列 10368 LUT 372 I/O RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-256
ORSO82G5-1BM680I 功能描述:FPGA - 現(xiàn)場可編程門陣列 10368 LUT 372 I/O RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-256
ORSO82G5-1F680C 功能描述:FPGA - 現(xiàn)場可編程門陣列 ORCA FPSC 2.7GBITS/s BP XCVR 643K RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-256
ORSO82G5-1F680I 功能描述:FPGA - 現(xiàn)場可編程門陣列 ORCA FPSC 2.7Gbits/s BP XCVR 643K RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-256
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