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參數(shù)資料
| 型號： | MQ80C52TXXX-20/883D |
| 廠商： | TEMIC SEMICONDUCTORS |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 8-BIT, MROM, 20 MHz, MICROCONTROLLER, CQFP44 |
| 文件頁數(shù)： | 298/604頁 |
| 文件大?。?/td> | 22337K |
| 代理商： | MQ80C52TXXX-20/883D |
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367
42073A-MCU Wireless-02/13
ATmega2564/1284/644RFR2
22.4 Register Description
22.4.1 SPCR – SPI Control Register
Bit
7
6
5
4
3
2
1
0
$2C ($4C)
SPIE
SPE
DORD
MSTR
CPOL
CPHA
SPR1
SPR0
SPCR
Read/Write
RW
Initial Value
0
Bit 7 – SPIE - SPI Interrupt Enable
This bit causes the SPI interrupt to be executed if SPIF bit in the SPSR Register is set
and the if the Global Interrupt Enable bit in SREG is set.s
Bit 6 – SPE - SPI Enable
When the SPE bit is set (one), the SPI is enabled. This bit must be set to enable any
SPI operations.
Bit 5 – DORD - Data Order
When the DORD bit is written to one, the LSB of the data word is transmitted first.
When the DORD bit is written to zero, the MSB of the data word is transmitted first.
Bit 4 – MSTR - Master/Slave Select
This bit selects Master SPI mode when written to one, and Slave SPI mode when
written logic zero. If the Slave Select pin is configured as an input and is driven low
while MSTR is set, MSTR will be cleared and SPIF in SPSR are set. The user will then
have to set MSTR to re-enable SPI Master mode.
Bit 3 – CPOL - Clock polarity
When this bit is written to one, SCK is high when idle. When CPOL is written to zero,
SCK is low when idle. Refer to the "Data Modes" section for an example. The CPOL
functionality is summarized below.
Table 22-3 CPOL Register Bits
Register Bits
Value
Description
CPOL
0
Rising (Leading Edge), Falling (Trailing
Edge)
1
Falling (Leading Egde), Rising (Trailing
Edge)
Bit 2 – CPHA - Clock Phase
The settings of the Clock Phase bit (CPHA) determine if data is sampled on the leading
(first) or trailing (last) edge of SCK. Refer to the "Data Modes" section for an example.
The CPOL functionality is summarized below.
Table 22-4 CPHA Register Bits
Register Bits
Value
Description
CPHA
0
Sample (Leading Edge), Setup (Trailing
Edge)
1
Setup (Leading Edge), Sample (Trailing
Edge)
Bit 1:0 – SPR1:0 - SPI Clock Rate Select 1 and 0
相關(guān)PDF資料 |
PDF描述 |
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