參數(shù)資料
型號(hào)： MK50H27Q25
廠商： STMICROELECTRONICS
元件分類： 微控制器/微處理器
英文描述： 1 CHANNEL(S), 51M bps, SERIAL COMM CONTROLLER, PQCC52
封裝： PLASTIC, LCC-52
文件頁(yè)數(shù)： 44/58頁(yè)
文件大?。?/td> 621K
代理商： MK50H27Q25
A 16-23
ALE
SYSCLK
BM0,1
READY
DAS
HLDA
HOLD
25
65
26
27
40
23
43
44
41
42
28
22
60
61
48
T 1
T 2
T 3
T 4
T 5
DATA
ADDR
DAL0-15
READ
DALO
DALI
29
34
33
35
45
ADDRESS
64
24
NOTES:
2. Output delay times are the maximum delay from the specifed edge to a valid output.
3. The Bus Master cycle time will increase from a minimum, in 1 SYSCLK increments
until the slave device returns READY.
1. This Reduced DMA Cycle Time is selected by setting CSR2 bit 15, CYCLE = 1.
Times T0 and T5 from the standard DMA Cycle are removed for this reduced timing.
Figure 8a MK50H27 Reduced Cycle BUS Master Timing (Write) (for CYCLE = 1, CSR2<15>)
MK50H27
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PDF描述
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參數(shù)描述
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