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參數(shù)資料
| 型號： | MC68HC705CL48 |
| 廠商： | FREESCALE SEMICONDUCTOR INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 8-BIT, OTPROM, 1.802 MHz, MICROCONTROLLER, PQFP112 |
| 封裝： | TQFP-112 |
| 文件頁數(shù)： | 108/145頁 |
| 文件大?。?/td> | 673K |
| 代理商： | MC68HC705CL48 |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁第102頁第103頁第104頁第105頁第106頁第107頁當(dāng)前第108頁第109頁第110頁第111頁第112頁第113頁第114頁第115頁第116頁第117頁第118頁第119頁第120頁第121頁第122頁第123頁第124頁第125頁第126頁第127頁第128頁第129頁第130頁第131頁第132頁第133頁第134頁第135頁第136頁第137頁第138頁第139頁第140頁第141頁第142頁第143頁第144頁第145頁
June 11, 1997
GENERAL RELEASE SPECIFICATION
MC68HC05CL48
TIMER
MOTOROLA
REV 2.0
8-13
IC1F - Input Capture Flag
1 =
Flag set when a selected polarity edge has been sensed by the
input capture edge detector.
0 =
Flag cleared by reading the timer status register (with IC1F set)
followed by accessing the low byte ($14) of the input capture
register.
IC2F - Input Capture Flag
1 =
Flag set when a selected polarity edge has been sensed by the
input capture edge detector.
0 =
Flag cleared by reading the timer status register (with IC2F set)
followed by accessing the low byte ($10) of the input capture
register.
OC1F - Output Compare 1 Flag
1 =
Flag set when the output compare register 1 contents matches the
contents of the free running counter.
0 =
Flag cleared by reading the timer status register (with OC1F set)
and then accessing the low byte ($16) of the output compare 1
register.
OC2F - Output Compare 2 Flag
1 =
Flag set when the output compare register 2 contents matches the
contents of the free running counter.
0 =
Flag cleared by reading the timer status register (with OC2F set)
and then accessing the low byte ($18) of the output compare 1
register.
TOF - Timer OVerow Flag
1 =
Flag set by transition of the free running counter from $FFFF to
$0000.
0 =
Flag cleared by reading the timer status register (with TOF set)
followed by an access of the free running counter least signicant
byte ($1A).
Accessing the timer status register satises the rst condition required to clear
status bits. The remaining step is to access the register corresponding to the
status bit.
A problem can occur when using the timer overow function and reading the free-
running counter at random times to measure an elapsed time. Without
incorporating the proper precautions into software, the timer overow ag could
unintentionally be cleared if:
1.
The timer status register is read or written when TOF is set, and
2.
The LSB of the free-running counter is read but not for the purpose of
servicing the ag.
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