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參數(shù)資料
| 型號： | FW32305 |
| 英文描述： | 1394A PCI PHY/Link Open Host Controller Interface |
| 中文描述： | 1394A端口物理層的PCI /鏈接開放主機(jī)控制器接口 |
| 文件頁數(shù)： | 86/152頁 |
| 文件大?。?/td> | 1625K |
| 代理商： | FW32305 |
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86
Agere Systems Inc.
FW323 05
1394A PCI PHY/Link Open Host Controller Interface
Data Sheet, Rev. 2
October 2001
Internal Registers
(continued)
Interrupt Event Register
The interrupt event set/clear register reflects the state of the various FW323 interrupt sources. The interrupt bits
are set by an asserting edge of the corresponding interrupt signal or by writing a 1 in the corresponding bit in the
set register. The only mechanism to clear the bits in this register is to write a 1 to the corresponding bit in the clear
register. This register is fully compliant with OHCI and the FW323 adds OHCI 1.0 compliant vendor-specific
interrupt function to bit 30. When reading the interrupt event register, the return value is the bit-wise AND function
of the interrupt event and interrupt mask registers per the 1394 Open Host Controller Interface Specification
Table 74. Interrupt Event Register
Bit
Field
Name
Reserved
vendorSpecific
Reserved
Type
Default
31
30
29
28
27
26
25
24
23
22
21
20
19
18
17
16
15
14
13
12
11
10
9
8
7
6
5
4
3
2
1
0
R
0
X
0
0
0
X
X
X
X
X
X
X
X
0
X
X
0
0
0
0
0
0
X
X
X
X
X
X
X
X
X
X
RSC
R
R
R
RSCU
RSCU
RSCU
RSCU
RSCU
RSCU
RSCU
RSCU
R
RSCU
RSCU
R
R
R
R
R
R
RSCU
RSCU
RU
RU
RSCU
RSCU
RSCU
RSCU
RSCU
RSCU
phyRegRcvd
cycleToolLong
unrecoverableError
cycleInconsistent
cycleLost
cycle64Seconds
cycleSynch
phy
Reserved
busReset
selfIDcomplete
Reserved
lockRespErr
postedWriteErr
isochRx
isochTx
RSPkt
RQPkt
ARRS
ARRQ
respTxComplete
reqTxComplete
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