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參數(shù)資料
| 型號： | FW32305 |
| 英文描述： | 1394A PCI PHY/Link Open Host Controller Interface |
| 中文描述： | 1394A端口物理層的PCI /鏈接開放主機控制器接口 |
| 文件頁數(shù)： | 41/152頁 |
| 文件大?。?/td> | 1625K |
| 代理商： | FW32305 |
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Agere Systems Inc.
41
Data Sheet, Rev. 2
October 2001
FW323 05
1394A PCI PHY/Link Open Host Controller Interface
Internal Registers
(continued)
Table 30. Power Management Control and Status Register Description
Bit
15
Field Name
PME_STS
Type
RC
Description
This bit is set when the FW323 would normally be asserting the PME
signal, independent of the state of the PME_ENB bit. This bit is
cleared by a writeback of 1, and this also clears the PME signal driven
by the FW323. Writing a 0 to this bit has no effect.
This field returns 0s when read, since the FW323 does not report
dynamic data.
This field returns 0s when read, since the FW323 does not report
dynamic data.
PME Enable.
This bit enables the function to assert PME. If this bit is
cleared, then assertion of PME is disabled.
Reserved.
Bits 7:5 return 0s when read.
Dynamic Data.
This bit returns 0 when read, since the FW323 does
not report dynamic data.
Reserved.
Bits 3:2 return 0s when read.
Power State.
This 2-bit field is used to set the FW323 device power
state and is encoded as follows:
14:13
DATA_SCALE
R
12:9
DATA_SELECTED
R
8
PME_ENB
RW
7:5
4
Reserved
DYN_DATA
R
R
3:2
1:0
Reserved
PWR_STATE
R
RW
00 = current power state is D0.
01 = current power state is D1.
10 = current power state is D2.
11 = current power state is D3.
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