參數(shù)資料
型號： FDC37B787-NS
廠商： STANDARD MICROSYSTEMS CORP
元件分類： 外設及接口
英文描述： Super I/O Controller with ACPI Support, Real Time Clock and Consumer IR
中文描述： MULTIFUNCTION PERIPHERAL, PQFP128
封裝： ROHS COMPLIANT, QFP-128
文件頁數(shù)： 177/249頁
文件大小： 932K
代理商： FDC37B787-NS
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180
LOGICAL DEVICE
REGISTER
ADDRESS
(0x71,0x73)
DESCRIPTION
STATE
Reserved - not implemented. These register
locations ignore writes and return zero when read.
Only 0x74 is implemented for FDC, Serial Port 2 and
Parallel port. 0x75 is not implemented and ignores
writes and returns zero when read. Refer to DMA
Channel Configuration.
DMA Channel Select
Default = 0x04
on Vcc POR or
Reset_Drv
32-Bit Memory
Space Configuration
Logical Device
(0x74,0x75)
C
(0x76-0xA8)
Reserved - not implemented. These register
locations ignore writes and return zero when read.
(0xA9-0xDF) Reserved - not implemented. These register
locations ignore writes and return zero when read.
(0xE0-0xFE)
Reserved - Vendor Defined (see SMSC defined
Logical Device Configuration Registers)
0xFF
Reserved
C
Logical Device
Config.
Reserved
C
C
Note 1: A logical device will be active and powered up according to the following equation:
DEVICE ON (ACTIVE) = (Activate Bit SET or Pwr/Control Bit SET).
The Logical device's Activate Bit and its Pwr/Control Bit are linked such that setting or clearing one sets or
clears the other.
Note: If the I/O Base Addr of the logical device is not within the Base I/O range as shown in the Logical
Device I/O map, then read or write is not valid and is ignored.
Note 2. The activate bit for Logical Device 5 (Serial Port 2) is reset on Vtr POR only.
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