參數(shù)資料
型號： FDC37B787-NS
廠商： STANDARD MICROSYSTEMS CORP
元件分類： 外設及接口
英文描述： Super I/O Controller with ACPI Support, Real Time Clock and Consumer IR
中文描述： MULTIFUNCTION PERIPHERAL, PQFP128
封裝： ROHS COMPLIANT, QFP-128
文件頁數(shù)： 174/249頁
文件大?。?/td> 932K
代理商： FDC37B787-NS
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177
REGISTER
Device ID
Hard wired
= 0x44
Device Rev
ADDRESS
0x20 R
DESCRIPTION
register
STATE
C
A
identification. Bits[7:0] = 0x44 when read
read
only
which
provides
device
Hard wired
= 0x00
PowerControl
Default = 0x00.
on Vcc POR or
Reset_Drv
hardware signal.
0x21 R
A read only register which provides device revision
information. Bits[7:0] = 0x00 when read
C
0x22 R/W
Bit[0] FDC Power
Bit[1] Reserved
Bit[2] Reserved
Bit[3] Parallel Port Power
Bit[4] Serial Port 1 Power
Bit[5] Serial Port 2 Power
Bit[6] Reserved
Bit[7] Reserved
= 0 Power off or disabled
= 1 Power on or enabled
Bit[0] FDC
Bit[1] Reserved
Bit[2] Reserved
Bit[3] Parallel Port
Bit[4] Serial Port 1
Bit[5] Serial Port 2
Bit[6]
Reserved (read as 0)
Bit[7]
Reserved (read as 0)
= 0 Intelligent Pwr Mgmt off
= 1 ntelligent Pwr Mgmt on
Bit[0] Reserved
Bit [1] PLL Control
= 0 PLL is on (backward Compatible)
= 1 PLL is off
Bits[3:2] OSC
= 01 Osc is on, BRG clock is on.
= 10 Same as above (01) case.
= 00 Osc is on, BRG Clock Enabled.
= 11 Osc is off, BRG clock is disabled.
Bit [6:4] Reserved, set to zero
Bit[7] IRQ8 Polarity
= 0 IRQ8 is active high
= 1 IRQ8 is active low
Reserved - Writes are ignored, reads return 0.
C
Power Mgmt
Default = 0x00.
on Vcc POR or
Reset_Drv
hardware signal
0x23 R/W
C
OSC
Default = 0x04,
on Vcc POR or
Reset_Drv
hardware signal.
0x24 R/W
C
Chip Level
Vendor Defined
0x25
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PDF描述
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