參數(shù)資料
型號(hào)： AD9991KCPZRL
廠商： Analog Devices Inc
文件頁(yè)數(shù)： 23/60頁(yè)
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描述： IC CCD SIGNAL PROCESSOR 56-LFCSP
產(chǎn)品變化通告： Product Discontinuance 27/Oct/2011
標(biāo)準(zhǔn)包裝： 2,500
類(lèi)型： CCD 信號(hào)處理器，10 位
輸入類(lèi)型： 邏輯
輸出類(lèi)型： 邏輯
接口： 3 線(xiàn)串口
安裝類(lèi)型： 表面貼裝
封裝/外殼： 56-VFQFN 裸露焊盤(pán)，CSP
供應(yīng)商設(shè)備封裝： 56-LFCSP-VQ（8x8）
包裝： 帶卷 (TR)
–3–
AD9991–SPECIFICATIONS
Parameter
Min
Typ
Max
Unit
TEMPERATURE RANGE
Operating
–20
+85
°C
Storage
–65
+150
°C
POWER SUPPLY VOLTAGE
AVDD (AFE Analog Supply)
2.7
3.0
3.6
V
TCVDD (Timing Core Analog Supply)
2.7
3.0
3.6
V
RGVDD (RG Driver)
2.7
3.0
3.6
V
HVDD (H1–H4 Drivers)
2.7
3.0
3.6
V
DRVDD (Data Output Drivers)
2.7
3.0
3.6
V
DVDD (Digital)
2.7
3.0
3.6
V
POWER DISSIPATION (See TPC 1 for Power Curves)
27 MHz, Typ Supply Levels, 100 pF H1–H4 Loading
270
mW
Power from HVDD Only
*
100
mW
Standby 1 Mode
105
mW
Standby 2 Mode
10
mW
Standby 3 Mode
0.5
mW
MAXIMUM CLOCK RATE (CLI)
27
MHz
*The total power dissipated by the HVDD supply may be approximated using the equation
Total HVDD Power = [CLOAD
HVDD
Pixel Frequency]
HVDD
Number of H-outputs used
Reducing the H-loading, using only two of the outputs, and/or using a lower HVDD supply will reduce the power dissipation.
Specications subject to change without notice.
DIGITAL SPECIFICATIONS
Parameter
Symbol
Min
Typ
Max
Unit
LOGIC INPUTS
High Level Input Voltage
VIH
2.1
V
Low Level Input Voltage
VIL
0.6
V
High Level Input Current
IIH
10
A
Low Level Input Current
IIL
10
A
Input Capacitance
CIN
10
pF
LOGIC OUTPUTS (Except H and RG)
High Level Output Voltage @ IOH = 2 mA
VOH
2.2
V
Low Level Output Voltage @ IOL = 2 mA
VOL
0.5
V
RG and H-DRIVER OUTPUTS (H1–H4)
High Level Output Voltage @ Max Current
VOH
VDD – 0.5
V
Low Level Output Voltage @ Max Current
VOL
0.5
V
Maximum Output Current (Programmable)
30
mA
Maximum Load Capacitance (For Each Output)
100
pF
Specications subject to change without notice.
(RGVDD = HVDD = DVDD = DRVDD = 2.7 V to 3.6 V, CL = 20 pF, TMIN to TMAX, unless otherwise noted.)
REV. 0
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PDF描述
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